參數(shù)資料
型號： ADV7441ABSTZ-5P
廠商： Analog Devices Inc
文件頁數(shù)： 11/28頁
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描述： IC DECODER DIGITIZER 144LQFP
標準包裝： 1
系列： Advantiv®
類型： 視頻解碼器
應用： HDTV，投影儀，機頂盒
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應商設備封裝： 144-LQFP（20x20）
包裝： 托盤
Data Sheet
ADV7441A
Rev. H | Page 19 of 28
Table 10. Component Processor Pixel Output Pin Map (P19 to P0)
Processor1
Mode
Format
Output of Data Port Pins P[19:0]
19
18
17
16
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
CP
Mode 1
Video output
8-bit 4:2:22
YCrCb[7:0]
CP
Mode 2
Video output
10-bit 4:2:22
YCrCb[9:0]
CP
Mode 3
Video output
12-bit 4:2:22
YCrCb[11:2]
CP
Mode 4
Video output
12-bit 4:2:22
YCrCb[11:4]
CP
Mode 5
Video output
12-bit 4:2:22
YCrCb[11:4]
YCrCb[3:0]
CP
Mode 6
Video output
16-bit 4:2:23, 4
CHA[7:0] (default data is Y[7:0])
CHB/CHC[7:0] (default data is
Cr/Cb[7:0])
CP
Mode 7
Video output
20-bit 4:2:23, 4
CHA[9:0] (default data is Y[9:0])
CHB/CHC[9:0] (default data is Cr/Cb[9:0])
CP
Mode 8
Video output
20-bit 4:2:223, 4
CHA[9:2] (default data is Y[9:2])
CHB/CHC[9:2] (default data is
Cr/Cb[9:2])
CP
Mode 9
Video output
24-bit 4:2:23,4
Y[11:2]
CrCb[11:2]
CP
Mode 10
Video output
24-bit 4:2:23,4
Y[11:4]
CrCb[11:4]
CP
Mode 11
Video output
24-bit 4:2:23,4
Y[11:4]
Y[3:0]
CrCb[3:0]
CP
Mode 12
Video output
24-bit 4:4:43, 4
CHA[7:0] (default data is G[7:0] or Y[7:0])
CHB[7:0] (default data is R[7:0]
or Cr[7:0])
CP
Mode 13
Video output
24-bit 4:4:43, 4
CHA[7:0] (default data is G[7:0] or Y[7:0])
CHC[7:0] (default data is B[7:0]
or Cb[7:0])
CP
Mode 14
Video output
24-bit 4:4:43, 4
CHC[7:0] (default data is B[7:0] or Cb[7:0])
CHA[7:0] (default data is G[7:0]
or Y[7:0])
CP
Mode 15
Video output
24-bit 4:4:43, 4
CHC[7:0] (default data is B[7:0] or Cb[7:0])
CHB[7:0] (default data is R[7:0]
or Cr[7:0])
CP
Mode 16
Video output
30-bit 4:4:43, 4
CHA[9:0] (default data is G[9:0] or Y[9:0])
CHB[9:0] (default data is R[9:0] or Cr[9:0])
CP
Mode 17
Video output
30-bit 4:4:43, 4
CHA[9:0] (default data is G[9:0] or Y[9:0])
CHC[9:0] (default data is B[9:0] or
Cb[9:0])
CP
Mode 18
Video output
30-bit 4:4:43, 4
CHC[9:0] (default data is B[9:0] or Cb[9:0])
CHA[9:0] (default data is G[9:0] or Y[9:0])
CP
Mode 19
Video output
30-bit 4:2:23, 4
CHC[9:0] (default data is B[9:0] or Cb[9:0])
CHB[9:0] (default data is R[9:0] or Cr[9:0])
1
The CP processor uses the digitizer or HDMI as input.
2
Maximum pixel clock rate of 54 MHz.
3
Maximum pixel clock rate of 170 MHz for analog digitizer.
4
Maximum pixel clock rate of 165 MHz for HDMI.
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ADV74425701 制造商:LG Corporation 功能描述:Frame Assembly
ADV74426701 制造商:LG Corporation 功能描述:Frame Assembly
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