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參數(shù)資料
| 型號： | ADUC814BRU |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 61/72頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC ADC 12BIT W/FLASH MCU 28TSSOP |
| 標(biāo)準(zhǔn)包裝： | 50 |
| 系列： | MicroConverter® ADuC8xx |
| 核心處理器： | 8052 |
| 芯體尺寸： | 8-位 |
| 速度： | 16.78MHz |
| 連通性： | I²C，SPI，UART/USART |
| 外圍設(shè)備： | POR，PSM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 17 |
| 程序存儲器容量： | 8KB（8K x 8） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大?。?/td> | 640 x 8 |
| RAM 容量： | 256 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 6x12b; D/A 2x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 28-TSSOP（0.173"，4.40mm 寬） |
| 包裝： | 管件 |
| 配用： | EVAL-ADUC814QSZ-ND - KIT DEV FOR ADUC814 MICROCONVRTR |
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ADuC814
Rev. A | Page 64 of 72
TIMING SPECIFICATIONS1,2,3
Table 34. Clock Input (External Clock Driven XTAL1)
AVDD = 2.7 V to 3.3 V or 4.75 V to 5.25 V, DVDD = 2.7 V to 3.3 V or 4.75 V to 5.25 V; all specifications TMIN to TMAX, unless otherwise noted
32.768 kHz External Crystal
Parameter
Min
Typ
Max
Unit
tCK
XTAL1 Period
30.52
s
tCKL
XTAL1 Width Low
15.16
s
tCKH
XTAL1 Width High
15.16
s
tCKR
XTAL1 Rise Time
20
ns
tCKF
XTAL1 Fall Time
20
ns
1/tCORE
ADuC814 Core Clock Frequency4
0.131
16.78
MHz
tCORE
ADuC814 Core Clock Period5
0.476
s
tCYC
ADuC814 Machine Cycle Time6
0.72
5.7
91.55
s
1 AC inputs during testing are driven at DVDD – 0.5 V for a Logic 1, and at 0.45 V for a Logic 0. Timing measurements are made at VIH min for a Logic 1, and at VIL max for a
Logic 0 as shown in Figure 61.
2 For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage occurs. A port pin begins to float when a 100 mV change from the
loaded VOH/VOL level occurs as shown in Figure 61.
3 CLOAD for all outputs = 80 pF, unless otherwise noted.
4 ADuC814 internal PLL locks onto a multiple (512 times) the external crystal frequency of 32.768 kHz to provide a stable 16.777216 MHz internal clock for the system.
The core can operate at this frequency or at a binary submultiple called Core_Clk, selected via the PLLCON SFR.
5 This number is measured at the default Core_Clk operating frequency of 2.09 MHz.
6 ADuC814 Machine Cycle Time is nominally defined as 12/Core_CLK.
tCKH
tCKL
tCK
tCKF
tCKR
02748-A
-002
Figure 60. XTAL1 Input
DVDD – 0.5V
0.45V
0. 2DV DD +0.9V
TEST POI NTS
0. 2DV DD –0.1V
VLOAD – 0.1V
VLOAD
VLOAD + 0.1V
VLOAD – 0.1V
VLOAD + 0.1V
TIMI NG
REFERENCE
POI NT
VLOAD
02748-A
-003
Figure 61. Timing Waveform Characteristics
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