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參數(shù)資料
| 型號： | ADUC7121BBCZ-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 60/96頁 |
| 文件大小： | 0K |
| 描述： | PRECISION ANALOG MCU I.C |
| 標準包裝： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 41.78MHz |
| 連通性： | I²C，SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲器容量： | 126KB（63K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 8K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 9x12b，D/A 4x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -10°C ~ 95°C |
| 封裝/外殼： | 108-LFBGA，CSPBGA |
| 包裝： | 標準包裝 |
| 其它名稱： | ADUC7121BBCZ-RLDKR |
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Data Sheet
ADuC7121
Rev. B | Page 63 of 96
I2C REGISTERS
The I2C peripheral interfaces consists of a number of MMRs. These are described in the following section.
I2C Master Registers
I2C Master Control Register
This 16-bit MMR configures I2C peripheral in master mode.
Name:
I2C0MCTL, I2C1MCTL
Address:
0xFFFF0880, 0xFFFF0900
Default value:
0x0000, 0x0000
Access:
Read/write
Table 89. I2CxMCTL MMR Bit Designations
Bit
Name
Description
15:9
Reserved. These bits are reserved; do not write to these bits.
8
I2CMCENI
I2C transmission complete interrupt enable bit.
Set this bit to enable an interrupt on detecting a stop condition on the I2C bus.
Clear this interrupt source.
7
I2CNACKENI
I2C no acknowledge received interrupt enable bit.
Set this bit to enable interrupts when the I2C master receives a no acknowledge.
Clear this interrupt source.
6
I2CALENI
I2C arbitration lost interrupt enable bit.
Set this bit to enable interrupts when the I2C master has been unsuccessful in gaining control of the I2C bus.
Clear this interrupt source.
5
I2CMTENI
I2C transmit interrupt enable bit.
Set this bit to enable interrupts when the I2C master has transmitted a byte.
Clear this interrupt source.
4
I2CMRENI
I2C receive interrupt enable bit.
Set this bit to enable interrupts when the I2C master receives data.
Cleared by the user to disable interrupts when the I2C master is receiving data.
3
I2CMSEN
I2C master SCL stretch enable bit.
Set this bit to 1 to enable clock stretching. When SCL is low, setting this bit forces the device to hold SCL low until
I2CMSEN is cleared. If SCL is high, setting this bit forces the device to hold SCL low after the next falling edge.
Clear this bit to disable clock stretching.
2
I2CILEN
I2C internal loopback enable.
Set this bit to enable loopback test mode. In this mode, the SCL and SDA signals are connected internally to their
respective input signals.
Cleared by the user to disable loopback mode.
1
I2CBD
I2C master back off disable bit.
Set this bit to allow the device to compete for control of the bus even if another device is currently driving a start
condition.
Clear this bit to back off until the I2C bus becomes free.
0
I2CMEN
I2C master enable bit.
Set by the user to enable I2C master mode.
Clear this bit to disable I2C master mode.
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PDF描述 |
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| ADUC7122BBCZ-RL | 功能描述:PRECISION ANALOG MCU I.C RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:MicroConverter® ADuC7xxx 標準包裝:38 系列:Encore!® XP® 核心處理器:eZ8 芯體尺寸:8-位 速度:5MHz 連通性:IrDA，UART/USART 外圍設(shè)備:欠壓檢測/復(fù)位，LED，POR，PWM，WDT 輸入/輸出數(shù):16 程序存儲器容量:4KB（4K x 8） 程序存儲器類型:閃存 EEPROM 大小:- RAM 容量:1K x 8 電壓 - 電源 (Vcc/Vdd):2.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:- 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 105°C 封裝/外殼:20-SOIC（0.295"，7.50mm 寬） 包裝:管件 其它名稱:269-4116Z8F0413SH005EG-ND |
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