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參數(shù)資料
| 型號(hào)： | ADAV803ASTZ |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | 8-Channel 14-Bit Single-Supply Voltage-Output DAC; Package: LQFP (10x10mm); No of Pins: 52; Temperature Range: Industrial |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP64 |
| 封裝： | ROHS COMPLIANT, MS-026BCD, LQFP-64 |
| 文件頁(yè)數(shù)： | 6/56頁(yè) |
| 文件大?。?/td> | 906K |
| 代理商： | ADAV803ASTZ |
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ADAV803
Parameter
Power-Down Current
Analog Current
Digital Current
Digital Interface Current
DIRIN/DIROUT Current
PLL Current
Power Supply Rejection
Signal at Analog Supply Pins
Rev. 0 | Page 6 of 56
Min
Typ
18
2.5
700
3.5
900
70
70
Max
Unit
mA
mA
μA
mA
μA
dB
dB
Comments
RESET low, no MCLK
1 kHz, 300 mV p-p
20 kHz, 300 mV p-p
1
Guaranteed by design.
TIMING SPECIFICATIONS
Timing specifications are guaranteed over the full temperature and supply range.
Table 3.
Parameter
MASTER CLOCK AND RESET
f
MCLK
MCLKI Frequency
f
XIN
XIN Frequency
t
RESET
RESET Low
I
2
C PORT
f
SCL
SCL Clock Frequency
t
SCLH
SCL High
t
SCLL
SCL Low
Start Condition
t
SCS
Setup Time
t
SCH
Hold Time
t
DS
Data Setup Time
t
SCR
SCL Rise Time
t
SCF
SCL Fall Time
t
SDR
SDA Rise Time
t
SDF
SDA Fall Time
Stop Condition
t
SCS
Setup Time
SERIAL PORTS
1
Slave Mode
t
SBH
xBCLK High
t
SBL
xBCLK Low
f
SBF
xBCLK Frequency
t
SLS
xLRCLK Setup
t
SLH
xLRCLK Hold
t
SDS
xSDATA Setup
t
SDH
xSDATA Hold
t
SDD
xSDATA Delay
Min
20
0.6
1.3
0.6
0.6
100
40
40
64 × f
S
10
10
10
10
10
Typ
12.288
27
0.6
Max
54
54
400
300
300
300
300
Unit
MHz
MHz
ns
kHz
μs
μs
μs
μs
ns
ns
ns
ns
ns
μs
ns
ns
ns
ns
ns
ns
ns
Comments
Relevant for repeated start condition
After this period, the first clock is generated
To xBCLK rising edge
From xBCLK rising edge
To xBCLK rising edge
From xBCLK rising edge
From xBCLK falling edge
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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