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參數(shù)資料
| 型號： | ADAV803ASTZ |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 消費家電 |
| 英文描述： | 8-Channel 14-Bit Single-Supply Voltage-Output DAC; Package: LQFP (10x10mm); No of Pins: 52; Temperature Range: Industrial |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP64 |
| 封裝： | ROHS COMPLIANT, MS-026BCD, LQFP-64 |
| 文件頁數(shù)： | 50/56頁 |
| 文件大小： | 906K |
| 代理商： | ADAV803ASTZ |
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ADAV803
Table 73. PLL Control Register 1
ADDRESS = 1110100 (0x74)
DIRIN_CLK1-0
Rev. 0 | Page 50 of 56
LK1
LK0
DIV
DIRIN_C
7
DIRIN_C
6
MCLKO
5
PLLDIV
PLL2PD
3
PLL1PD
2
XTLPD
1
SYSCLK3
0
nt to SYSCLK3.
Recovered SPDIF clock se
00 = SYSCLK3 comes from PLL block.
.
01 = Reserved
10 = Reserved.
11 = SYSCLK3 is
Divide input MCLK by 2 to
0 = Disabled.
1 = Enabled
Divide XIN b
0 = Disabled.
1 = Enabled
Power-down P
0 = Normal.
1 = Power-down.
Power-down PLL1.
0 = Normal.
1 = Power-d
Power-dow
0 = Normal.
1 = Power-
Clock output
0 = 512 × f
S
.
1 = 256 × f
S
.
the recovered SPDIF clock from DIRIN.
generate MCLKO.
CLKODIV
.
y 2 to generate the PLL master clock.
.
LL2.
own.
n XTAL oscillator.
down.
for SYSCLK3.
M
PLLDIV
PLL2PD
PLL1PD
XTLPD
SYSCLK3
Table 74. PLL Control Register 2
ADDRESS = 1110101 (0x75)
FS2_1–0
SEL2
DO
FS1–0
SEL2
5
DOUB2
4
FS1
3
FS0
2
SEL1
1
DOUB1
0
FS2_1
7
FS2_0
6
Sampl rate se
00 = 48 kHz.
01 = Reserved.
10 = 32 kH
11 = 44.1 kHz
Oversample rat
0 = 256 × f
S
.
1 = 384 × f
S
.
Double-se
0 = Disabled.
1 = Enable
Sample rate
00 = 48 kHz.
01 = Rese
10 = 32 kHz
t for PLL2.
lec
z.
.
io select for PLL2.
UB2
lected sample rate on PLL2.
d.
select for PLL1.
rved.
.
11 = 44.1 kHz.
Oversample ratio select for PLL1.
0 = 256 × f
S
.
1 = 384 × f
S
.
Double-selected sample rate on PLL1.
0 = Disabled.
1 = Enabled.
SEL1
DOUB1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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