參數(shù)資料
型號(hào): ADAU1461WBCPZ
廠商: Analog Devices Inc
文件頁(yè)數(shù): 48/88頁(yè)
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描述: IC SIGMADSP 24BIT 96KHZ PLL 32
標(biāo)準(zhǔn)包裝: 1
系列: SigmaDSP®
類型: 音頻處理器
應(yīng)用: 車載音頻
安裝類型: 表面貼裝
封裝/外殼: 32-VFQFN 裸露焊盤,CSP
供應(yīng)商設(shè)備封裝: 32-LFCSP-VQ
包裝: 托盤
ADAU1461
Rev. 0 | Page 52 of 88
R2: Digital Microphone/Jack Detection Control, 16,392 (0x4008)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
JDDB[1:0]
JDFUNC[1:0]
Reserved
JDPOL
Table 35. Digital Microphone/Jack Detection Control Register
Bits
Bit Name
Description
[7:6]
JDDB[1:0]
Jack detect debounce time.
Setting
Debounce Time
00
5 ms (default)
01
10 ms
10
20 ms
11
[5:4]
JDFUNC[1:0]
JACKDET/MICIN pin function. Enables or disables the jack detect function or configures the pin for a digital
microphone input.
40 ms
Setting
Pin Function
00
Jack detect off (default)
01
Jack detect on
10
Digital microphone input
11
0
JDPOL
Jack detect polarity. Detects high or low signal.
0 = detect high signal (default).
1 = detect low signal.
Reserved
R4: Record Mixer Left (Mixer 1) Control 0, 16,394 (0x400A)
This register controls the gain of single-ended inputs for the left channel record path. The left channel record mixer is referred to as Mixer 1.
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reserved
LINPG[2:0]
LINNG[2:0]
MX1EN
Table 36. Record Mixer Left (Mixer 1) Control 0 Register
Bits
Bit Name
Description
[6:4]
LINPG[2:0]
Gain for a left channel single-ended input from the LINP pin, input to Mixer 1.
Setting
Gain
000
Mute (default)
001
12 dB
010
9 dB
011
6 dB
100
3 dB
101
0 dB
110
3 dB
111
6 dB
[3:1]
LINNG[2:0]
Gain for a left channel single-ended input from the LINN pin, input to Mixer 1.
Setting
Gain
000
Mute (default)
001
12 dB
010
9 dB
011
6 dB
100
3 dB
101
0 dB
110
3 dB
111
6 dB
0
MX1EN
Left channel mixer enable in the record path. Referred to as Mixer 1.
0 = mixer disabled (default).
1 = mixer enabled.
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PDF描述
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參數(shù)描述
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