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參數(shù)資料
| 型號： | 72V3626L15PFG |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | FIFO |
| 英文描述： | 256 X 36 BI-DIRECTIONAL FIFO, 10 ns, PQFP128 |
| 封裝： | GREEN, TQFP-128 |
| 文件頁數(shù)： | 4/36頁 |
| 文件大小： | 349K |
| 代理商： | 72V3626L15PFG |
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12
COMMERCIALTEMPERATURERANGE
IDT72V3626/72V3636/72V3646 CMOS 3.3V TRIPLE BUS SyncFIFOTM
WITH BUS-MATCHING 256 x 36 x 2, 512 x 36 x 2, 1,024 x 36 x 2
CSA
W/
RA
ENA
MBA
CLKA
Data A(A0-A35) I/O
PORT FUNCTION
H
X
High-Impedance
None
L
H
L
X
Input
None
LH
H
L
↑
Input
FIFO1 write
LH
H
↑
Input
Mail1 write
L
X
Output
None
LL
H
L
↑
Output
FIFO2 read
L
H
X
Output
None
LL
H
↑
Output
Mail2 read (set
MBF2 HIGH)
CSB
RENB
MBB
CLKB
Data B (B0-B17) Outputs
PORT FUNCTION
H
X
High-Impedance
None
L
X
Output
None
LH
L
↑
Output
FIFO1 read
L
H
X
Output
None
LH
H
↑
Output
Mail1 read (set
MBF1 HIGH)
TABLE 4 — PORT C ENABLE FUNCTION TABLE
TABLE 3 — PORT B ENABLE FUNCTION TABLE
WENC
MBC
CLKC
Data C (C0-C17) Inputs
PORT FUNCTION
HL
↑
Input
FIFO2 write
HH
↑
Input
Mail2 write
L
X
Input
None
L
H
X
Input
None
LOW, and
FFA/IRA is HIGH. Data is read from FIFO2 to the A0-A35 outputs
by a LOW-to-HIGH transition of CLKA when
CSAisLOW,W/RAisLOW,ENA
is HIGH, MBA is LOW, and
EFA/ORAisHIGH(seeTable2).FIFOreadsand
writesonPortAareindependentofanyconcurrentPortBandPortCoperation.
ThestateofthePortBdata(B0-B17)outputsiscontrolledbythePortBChip
Select(
CSB).TheB0-B17outputsareinthehigh-impedancestatewhenCSB
is HIGH. The B0-B17 outputs are active when
CSB is LOW.
DataisreadfromFIFO1totheB0-B17outputsbyaLOW-to-HIGHtransition
of CLKB when
CSB is LOW, RENB is HIGH, MBB is LOW and EFB/ORB is
HIGH (see Table 3). FIFO reads on Port B are independent of any concurrent
Port A and Port C operations.
Data is loaded into FIFO2 from the C0-C17 inputs on a LOW-to-HIGH
transition of CLKC when WENB is HIGH, MBC is LOW, and
FFC/IRCisHIGH
(see Table 4). FIFO writes on Port C are independent of any concurrent Port
A and Port B operation.
Thesetupandholdtimeconstraintsfor
CSAandW/RAwithregardtoCLKA
as well as
CSB with regard to CLKB are only for enabling write and read
operations and are not related to high-impedance control of the data outputs.
If ENA is LOW during a clock cycle, either
CSA or W/RA may change states
during the setup and hold time window of the cycle. This is also true for
CSB
when RENB is LOW.
WhenoperatingtheFIFOinFWFTmodeandtheOutputReadyflagisLOW,
the next word written is automatically sent to the FIFO’s output register by the
LOW-to-HIGHtransitionoftheportclockthatsetstheOutputReadyflagHIGH.
When the Output Ready flag is HIGH, subsequent data is clocked to the output
registersonlywhenareadisselectedusing
CSA,W/RA,ENAandMBAatPort
A or using
CSB, RENB and MBB at Port B.
When operating the FIFO in IDT Standard mode, the first word will cause
the Empty Flag to change state on the second LOW-to-HIGH transition of the
Read Clock. The data word will not be automatically sent to the output register.
Instead, data residing in the FIFO’s memory array is clocked to the output
register only when a read is selected using
CSA,W/RA,ENAandMBAatPort
A or using
CSB, RENB and MBB at Port B. Relevant write and read timing
diagrams for Port A can be found in Figure 10 and 15. Relevant read and write
timing diagrams for Port B and Port C, together with Bus-Matching and Endian
select operation, can be found in Figure 11 to 14.
TABLE 2 — PORT A ENABLE FUNCTION TABLE
相關PDF資料 |
PDF描述 |
|---|---|
| 72V3684L15PF | 16K X 36 BI-DIRECTIONAL FIFO, 10 ns, PQFP128 |
| 72V845L15PFI8 | 4K X 18 BI-DIRECTIONAL FIFO, 10 ns, PQFP128 |
| 72V805L15PFI9 | 256 X 18 BI-DIRECTIONAL FIFO, 10 ns, PQFP128 |
| 72V805L15PF8 | 256 X 18 BI-DIRECTIONAL FIFO, 10 ns, PQFP128 |
| 7305-0-15-15-47-14-04-0 | BRASS, GOLD FINISH, PCB TERMINAL |
相關代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 72V3631L15PF | 功能描述:IC SYNCFIFO 512X36 15NS 120-TQFP 制造商:idt, integrated device technology inc 系列:72V 包裝:托盤 零件狀態(tài):過期 存儲容量:18K（512 x 36） 功能:同步 數(shù)據(jù)速率:66.7MHz 訪問時間:10ns 電壓 - 電源:3 V ~ 3.6 V 電流 - 電源（最大值）:400μA 總線方向:雙向 擴充類型:深度，寬度 可編程標志支持:是 中繼能力:是 FWFT 支持:是 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:120-LQFP 供應商器件封裝:120-TQFP（14x14） 標準包裝:45 |
| 72V3631L15PF8 | 功能描述:IC SYNCFIFO 512X36 15NS 120-TQFP 制造商:idt, integrated device technology inc 系列:72V 包裝:帶卷（TR） 零件狀態(tài):過期 存儲容量:18K（512 x 36） 功能:同步 數(shù)據(jù)速率:66.7MHz 訪問時間:10ns 電壓 - 電源:3 V ~ 3.6 V 電流 - 電源（最大值）:400μA 總線方向:雙向 擴充類型:深度，寬度 可編程標志支持:是 中繼能力:是 FWFT 支持:是 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:120-LQFP 供應商器件封裝:120-TQFP（14x14） 標準包裝:750 |
| 72V3631L15PFG | 功能描述:IC FIFO SYNC 512X36 15NS 120TQFP 制造商:idt, integrated device technology inc 系列:72V 包裝:托盤 零件狀態(tài):有效 存儲容量:18K（512 x 36） 功能:同步 數(shù)據(jù)速率:66.7MHz 訪問時間:10ns 電壓 - 電源:3 V ~ 3.6 V 電流 - 電源（最大值）:400μA 總線方向:雙向 擴充類型:深度，寬度 可編程標志支持:是 中繼能力:是 FWFT 支持:是 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:120-LQFP 供應商器件封裝:120-TQFP（14x14） 標準包裝:45 |
| 72V3631L15PFG8 | 功能描述:IC FIFO SYNC 512X36 15NS 120TQFP 制造商:idt, integrated device technology inc 系列:72V 包裝:帶卷（TR） 零件狀態(tài):有效 存儲容量:18K（512 x 36） 功能:同步 數(shù)據(jù)速率:66.7MHz 訪問時間:10ns 電壓 - 電源:3 V ~ 3.6 V 電流 - 電源（最大值）:400μA 總線方向:雙向 擴充類型:深度，寬度 可編程標志支持:是 中繼能力:是 FWFT 支持:是 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:120-LQFP 供應商器件封裝:120-TQFP（14x14） 標準包裝:750 |
| 72V3631L15PQF | 功能描述:IC SYNCFIFO 512X36 15NS 132QFP 制造商:idt, integrated device technology inc 系列:72V 包裝:托盤 零件狀態(tài):過期 存儲容量:18K（512 x 36） 功能:同步 數(shù)據(jù)速率:66.7MHz 訪問時間:10ns 電壓 - 電源:3 V ~ 3.6 V 電流 - 電源（最大值）:400μA 總線方向:雙向 擴充類型:深度，寬度 可編程標志支持:是 中繼能力:是 FWFT 支持:是 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:132-BQFP 緩沖式 供應商器件封裝:132-PQFP（24.13x24.13） 標準包裝:36 |
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