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參數(shù)資料
| 型號： | 21041 |
| 廠商： | Intel Corp. |
| 英文描述： | Digital Semiconductor 21041 PCI Ethernet LAN Controller(數(shù)字半導體21041 PCI以太網(wǎng)LAN控制器) |
| 中文描述： | 數(shù)字半導體21041 PCI以太網(wǎng)局域網(wǎng)控制器（數(shù)字半導體21041的PCI以太網(wǎng)局域網(wǎng)控制器） |
| 文件頁數(shù)： | 26/64頁 |
| 文件大?。?/td> | 230K |
| 代理商： | 21041 |
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Table 4 (Cont.) Quick Pin Reference
Signal
Type
Pin
Number
Description
trdy_l
I/O
43
Target ready indicates the target agent’s
ability to complete the current data phase of
the transaction.
A data phase is completed on any clock when
both
trdy_l
and initiator ready (
irdy_l
) are
asserted. Wait cycles are inserted until both
irdy_l
and
trdy_l
are asserted together.
When the 21041 is the bus initiator,
trdy_l
is asserted by the bus target on the read
operation indicating that valid data is present
on
ad<31:00>
. During a write cycle, it
indicates that the target is prepared to accept
data.
Capacitor input for analog PLL logic.
3.3-volt supply input voltage.
vcap_h
vdd
I
I
88
See
Figure 2.
See
Figure 2.
10
vddac
I
3.3-volt supply input for analog PLL logic.
vdd_clamp
I
Supplies +5.0 volts or +3.3 volts reference for
the clamp logic.
Ground pin.
vss
—
See
Figure 2.
84
83
xtal1
xtal2
I
O
Crystal oscillator input.
Crystal feedback output pin used for crystal
connections only. If this pin is unused, then
do not connect it.
18
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