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參數(shù)資料
| 型號： | μPD78F9831 |
| 廠商： | NEC Corp. |
| 英文描述： | 8 Bit Single Chip Microcontrollers(8 位微控制器) |
| 中文描述： | 8位單片機(jī)微控制器（8位微控制器） |
| 文件頁數(shù)： | 95/211頁 |
| 文件大?。?/td> | 1262K |
| 代理商： | ΜPD78F9831 |
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CHAPTER 5 CLOCK GENERATION CIRCUIT
95
Figure 5-7. Unacceptable Resonator Connections (2/2)
(e) Signal is extracted
(f) Signal conductors of the main and subsystem
clocks are parallel and near to each other
V
SS0
,
V
SS1
X1
X2
V
SS0
,
V
SS1
X2
XT2 and X1 wiring in parallel
X1
XT2
XT1
Remark
When using the subsystem clock, read X1 and X2 as XT1 and XT2, respectively, and connect a
resistor to the XT2 in series.
Caution
If the X1 wire is in parallel with the XT2 wire, crosstalk noise may occur between the X1 and
XT2, resulting in a malfunction.
To avoid this, do not lay the X1 and XT2 wires in parallel.
5.4.3 Scaler
The scaler divides the main system clock oscillator output (f
X
) and generates clocks.
5.4.4 When no subsystem clocks are used
If it is not necessary to use subsystem clocks for low power consumption operations and clock operations,
connect the XT1 and XT2 pins as follows.
XT1: Connect to V
SS0
or V
SS1
XT2: Open
In this state, however, some current may leak via the internal feedback resistor of the subsystem clock oscillator
when the main system clock stops. To minimize the leakage current, the above internal feedback resistor can be
removed by setting bit 1 (FRC) of the suboscillation mode register (SCKM). In this case, also connect the XT1 and
XT2 pins as described above.
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