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參數(shù)資料
| 型號(hào)： | μPD78F9026 |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8 Bit Single Chip Microcontrollers |
| 中文描述： | 8位單片機(jī)微控制器 |
| 文件頁數(shù)： | 21/48頁 |
| 文件大?。?/td> | 248K |
| 代理商： | ΜPD78F9026 |
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Preliminary Data Sheet
21
PD78F9026
Flag
Z
AC CY
OR
A, #byte
2
4
A
A byte
saddr, #byte
3
6
(saddr)
(saddr) byte
A, r
2
4
A
A r
A, saddr
2
4
A
A (saddr)
A, !addr16
3
8
A
A (addr16)
A, [HL]
1
6
A
A (HL)
A, [HL + byte]
2
6
A
A (HL + byte)
XOR
A, #byte
2
4
A
A byte
saddr, #byte
3
6
(saddr)
(saddr) byte
A, r
2
4
A
A r
A, saddr
2
4
A
A (saddr)
A, !addr16
3
8
A
A (addr16)
A, [HL]
1
6
A
A (HL)
A, [HL + byte]
2
6
A
A (HL + byte)
CMP
A, #byte
2
4
A byte
saddr, #byte
3
6
(saddr) byte
A, r
2
4
A r
A, saddr
2
4
A (saddr)
A, !addr16
3
8
A (addr16)
A, [HL]
1
6
A (HL)
A, [HL + byte]
2
6
A (HL + byte)
ADDW
AX, #word
3
6
AX, CY
AX + word
SUBW
AX, #word
3
6
AX, CY
AX word
CMPW
AX, #word
3
6
AX word
INC
r
2
4
r
r + 1
saddr
2
4
(saddr)
(saddr) + 1
DEC
r
2
4
r
r 1
saddr
2
4
(saddr)
(saddr) 1
INCW
rp
1
4
rp
rp + 1
DECW
rp
1
4
rp
rp 1
ROR
A, 1
1
2
(CY, A
7
A
0
, A
m 1
A
m
) 1
ROL
A, 1
1
2
(CY, A
0
A
7
, A
m+1
A
m
) 1
RORC
A, 1
1
2
(CY
A
0
, A
7
CY, A
m 1
A
m
) 1
ROLC
A, 1
1
2
(CY
A
7
, A
0
CY, A
m+1
A
m
) 1
Remark
The instruction clock cycle is based on the CPU clock (f
CPU
), specified in the processor clock controller
register (PCC).
Operation
Mnemonic
Operand
Byte
Clock
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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