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參數(shù)資料
| 型號(hào)： | ZPSD401A1 |
| 英文描述： | Field Programmable Microcontroller Peripherals(可編程邏輯，零功耗，16K位SRAM,40個(gè)可編程I/O,通用PLD有37個(gè)輸入) |
| 中文描述： | 現(xiàn)場(chǎng)可編程微控制器外圍設(shè)備（可編程邏輯，零功耗，16K的位的SRAM，40余個(gè)可編程輸入/輸出，通用PLD的有37個(gè)輸入） |
| 文件頁(yè)數(shù)： | 75/108頁(yè) |
| 文件大?。?/td> | 626K |
| 代理商： | ZPSD401A1 |
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ZPSD4XX Famly
5-75
System
Configuration
(Cont.)
Register Name
Register Function
Data In
This Register is used to read the input on the port pins.
Control
A
“
0
”
sets the corresponding port pin in Address Out Mode.
A
“
1
”
sets the pin in MCU I/O Mode.
Data Out
Holds the output data in the MCU I/O Mode.
This register is used to control the data flow in the I/O ports.
A
“
0
”
sets the corresponding pin as an input pin.
A
“
1
”
sets the pin as an output pin.
Direction
Open Drain
A
“
0
”
sets the corresponding pin driver as a CMOS driver.
A
“
1
”
sets the pin driver as an Open Drain Driver.
PLD – I/O
A read only status register; a
“
1
”
indicates the corresponding pin
is configured as a PLD pin.
Macrocell Out
This register holds the outputs of the GPLD macrocells.
Page Register
A 4-bit register that supports paging.
1. Configures the ZPSD4XX SRAM to be accessed by
“
PSEN
”
as program space (8031 design).
2. Enables the Peripheral I/O Mode of Port A.
VM
PMMR0
PMMR1
Power management registers; enables the ZPSD4XX Power Down
Mode and other power saving configurations.
Table 23. Register Function
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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