參數(shù)資料
型號(hào)： Z90T361PZ016SC
英文描述： Microcontroller
中文描述： 微控制器
文件頁(yè)數(shù)： 57/187頁(yè)
文件大?。?/td> 2235K
代理商： Z90T361PZ016SC
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Z90T366 ROM and Z90T361 OTP
eZVision 64 KWord Television Controller with OSD
PS005901-1100
49
If the master I
2
C interface is enabled, the corresponding I/Os, Port11 and Port12
must be assigned as outputs. (The Z90T366 does not have pins to support a
slave interface.)
The VCO, DOT, and SCLK frequency are defined as the following:
F
VCO
= F
DOT
= F
SCLK
= XTAL * (256 + PLL
DATA
)
Therefore,
XTAL = 32.768 KHz
At POR, the PLL frequency data register is preset to 70h, which corresponds to
the VCO frequency of 12.058 MHz.
The PLL_data field can be loaded with any value from 00h. This value
corresponds to an SCLK = 256*XTAL up to FFh, which corresponds to an SCLK =
511*XTAL.
Table 21 through Table 25 describe the bits in registers 3 through 7.
Reg Field
Bit Position
R
W
Data Description
M_disable
f---------------
R
W
1
0
I
2
C Master interface disabled
I
2
C Master interface enabled–POR
S_disable
-e--------------
R
W
1
0
I
2
C Slave interface disabled
I
2
C Slave interface enabled–POR
I
2
CM_mux
--d-------------
R
W
1
0
Select I
2
MSD2, I
2
MSC2–POR
Select I
2
MSD1, I
2
MSC1
I
2
C_Out_
Resistance
---c------------
R
W
1
0
600
output resistance
Normal CMOS port output
resistance–POR
I
2
C_speed
_range
----b-----------
R
W
1
0
Low speed range (10 KHz, 50 KHz)
High speed range (100 KHz, 400
KHz)–POR
Reserved
-----a----------
Reserved
P46/
HSYNC2
------9---------
R
W
10
HSYNC logic takes input from
HSYNC pin–POR. This bit must
always be set to
0
.
P07/
CSYNC
-------8--------
R
W
1
0
Composite Sync Output
P07 I/O–POR
PLL_data
--------76543210
R
W
D
PLL divider = 256 + D
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PDF描述
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Z9104CAB SCR Thyristor; SCR Type:Standard Gate; Peak Repetitive Off-State Voltage, Vdrm:800V; On-State RMS Current, IT(rms):8A; Peak Non Repetitive Surge Current, Itsm:100A; Gate Trigger Current Max, Igt:15uA
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Z-9216 制造商:ProTek Devices 功能描述:
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