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參數(shù)資料
| 型號： | XCV812E-7FG900I |
| 廠商： | XILINX INC |
| 元件分類： | FPGA |
| 英文描述： | Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
| 中文描述： | FPGA, 4704 CLBS, 254016 GATES, 400 MHz, PBGA900 |
| 封裝： | PLASTIC, FBGA-900 |
| 文件頁數(shù)： | 58/116頁 |
| 文件大?。?/td> | 1087K |
| 代理商： | XCV812E-7FG900I |
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Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays
Module 3 of 4
4
www.xilinx.com
1-800-255-7778
DS025-3 (v2.2) July 17, 2002
R
LVDS DC Specifications
LVPECL DC Specifications
These values are valid at the output of the source termination pack shown under
LVPECL
, with a 100
differential load only.
The V
OH
levels are 200 mV below standard LVPECL levels and are compatible with devices tolerant of lower common-mode
ranges. The following table summarizes the DC output specifications of LVPECL.
DC Parameter
Symbol
Conditions
Min
Typ
Max
Units
Supply Voltage
V
CCO
2.375
2.5
2.625
V
Output High Voltage for Q and Q
V
OH
R
T
= 100
across Q and Q signals
R
T
= 100
across Q and Q signals
R
T
= 100
across Q and Q signals
1.25
1.425
1.6
V
Output Low Voltage for Q and Q
V
OL
0.9
1.075
1.25
V
Differential Output Voltage (Q – Q),
Q = High (Q – Q), Q = High
V
ODIFF
250
350
450
mV
Output Common-Mode Voltage
V
OCM
R
T
= 100
across Q and Q signals
1.125
1.25
1.375
V
Differential Input Voltage (Q – Q),
Q = High (Q – Q), Q = High
V
IDIFF
Common-mode input voltage = 1.25 V
100
350
NA
mV
Input Common-Mode Voltage
V
ICM
Differential input voltage =
±
350 mV
0.2
1.25
2.2
V
Notes:
1.
Refer to the Design Consideration section for termination schematics.
DC Parameter
Min
Max
Min
Max
Min
Max
Units
V
CCO
3.0
3.3
3.6
V
V
OH
1.8
2.11
1.92
2.28
2.13
2.41
V
V
OL
0.96
1.27
1.06
1.43
1.30
1.57
V
V
IH
1.49
2.72
1.49
2.72
1.49
2.72
V
V
IL
0.86
2.125
0.86
2.125
0.86
2.125
V
Differential Input Voltage
0.3
-
0.3
-
0.3
-
V
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