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參數(shù)資料
| 型號： | XC9536XL |
| 廠商： | Xilinx, Inc. |
| 英文描述： | FastFLASH High-Performance CPLD(FastFLASH 高性能復(fù)雜可編程邏輯器件) |
| 中文描述： | FastFLASH高性能的CPLD（FastFLASH高性能復(fù)雜可編程邏輯器件） |
| 文件頁數(shù)： | 10/16頁 |
| 文件大小： | 143K |
| 代理商： | XC9536XL |
R
FastFLASH XC9500XL High-Performance CPLD Family
5-14
June 7, 1999 (Version 1.5)
I/O Block
Macrocell
X5899_01
Product Term OE
PTOE
Switch Matrix
OUT
(Inversion in
AND-array)
Global OE 1
1
To other
Macrocells
Slew Rate
Control
0
Global OE 2
Available in XC95144XL
and XC95288XL
Global OE 3
Global OE 4
I/O/GTS1
I/O
I/O/GTS2
I/O/GTS3
I/O/GTS4
To FastCONNECT
User-
Programmable
Ground
Bus-Hold
I/O Block
The I/O Block (IOB) interfaces between the internal logic
and the device user I/O pins. Each IOB includes an input
buffer, output driver, output enable selection multiplexer,
and user programmable ground control. See
Figure 10
for
details.
Figure 10: I/O Block and Output Enable Capability
The input buffer is compatible with 5V CMOS, 5V TTL, 3.3V
CMOS, and 2.5V CMOS signals. The input buffer uses the
internal 3.3V voltage supply (V
CCINT
) to ensure that the
input thresholds are constant and do not vary with the
V
CCIO
voltage. Each input buffer provides input hysteresis
(50 mV typical) to help reduce system noise for input sig-
nals with slow rise or fall edges.
Each output driver is designed to provide fast switching
with minimal power noise. All output drivers in the device
may be configured for driving either 3.3V CMOS levels
(which are compatible with 5V TTL levels as well) or 2.5V
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PDF描述 |
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