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參數(shù)資料
| 型號(hào)： | XC6VCX195T-2FFG784I |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 2/52頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA VIRTEX 6 199K 784FFGBGA |
| 產(chǎn)品培訓(xùn)模塊： | Virtex-6 FPGA Overview |
| 產(chǎn)品變化通告： | Virtex-6 FIFO Input Logic Reset 18/Apr/2011 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Virtex® 6 CXT |
| LAB/CLB數(shù)： | 15600 |
| 邏輯元件/單元數(shù)： | 199680 |
| RAM 位總計(jì)： | 12681216 |
| 輸入/輸出數(shù)： | 400 |
| 電源電壓： | 0.95 V ~ 1.05 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 784-BBGA，F(xiàn)CBGA |
| 供應(yīng)商設(shè)備封裝： | 784-FCBGA |
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Virtex-6 CXT Family Data Sheet
DS153 (v1.6) February 11, 2011
Product Specification
10
X-Ref Target - Figure 9
Figure 9: Placement Diagram for the FF1156 Package
(3 of 4)
CX130T: GTXE1_X0Y7
CX195T: GTXE1_X0Y7
CX240T: GTXE1_X0Y7
CX130T: GTXE1_X0Y6
CX195T: GTXE1_X0Y6
CX240T: GTXE1_X0Y6
QUAD_114
CX130T: GTXE1_X0Y5
CX195T: GTXE1_X0Y5
CX240T: GTXE1_X0Y5
CX130T: GTXE1_X0Y4
CX195T: GTXE1_X0Y4
CX240T: GTXE1_X0Y4
R3
R4
P1
P2
U3
U4
T1
T2
T6
T5
V6
V5
W3
W4
V1
V2
AA3
AA4
Y1
Y2
MGTRXP3_114
MGTRXN3_114
MGTTXP3_114
MGTTXN3_114
MGTRXP2_114
MGTRXN2_114
MGTTXP2_114
MGTTXN2_114
MGTREFCLK1P_114
MGTREFCLK1N_114
MGTREFCLK0P_114
MGTREFCLK0N_114
MGTRXP1_114
MGTRXN1_114
MGTTXP1_114
MGTTXN1_114
MGTRXP0_114
MGTRXN0_114
MGTTXP0_114
MGTTXN0_114
ds153_09_020210
X-Ref Target - Figure 10
Figure 10: Placement Diagram for the FF1156 Package
(4 of 4)
CX130T: GTXE1_X0Y3
CX195T: GTXE1_X0Y3
CX240T: GTXE1_X0Y3
CX130T: GTXE1_X0Y2
CX195T: GTXE1_X0Y2
CX240T: GTXE1_X0Y2
QUAD_113
CX130T: GTXE1_X0Y1
CX195T: GTXE1_X0Y1
CX240T: GTXE1_X0Y1
CX130T: GTXE1_X0Y0
CX195T: GTXE1_X0Y0
CX240T: GTXE1_X0Y0
AC3
AC4
AB1
AB2
AE3
AE4
AD1
AD2
AB6
AB5
AD6
AD5
AF5
AF6
AF1
AF2
AG3
AG4
AH1
AH2
MGTRXP3_113
MGTRXN3_113
MGTTXP3_113
MGTTXN3_113
MGTRXP2_113
MGTRXN2_113
MGTTXP2_113
MGTTXN2_113
MGTREFCLK1P_113
MGTREFCLK1N_113
MGTREFCLK0P_113
MGTREFCLK0N_113
MGTRXP1_113
MGTRXN1_113
MGTTXP1_113
MGTTXN1_113
MGTRXP0_113
MGTRXN0_113
MGTTXP0_113
MGTTXN0_113
ds153_10_020210
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