參數(shù)資料
型號： VSC8114
廠商： Vitesse Semiconductor Corporation.
英文描述： ATM/SONET/SDH 622 Mb/s Transceiver Mux/Demux with Integrated Clock Generation and Clock Recovery
中文描述： 自動柜員機(jī)/ SONET / SDH的622 Mb / s的集成時鐘發(fā)生器和時鐘恢復(fù)器/解復(fù)用器
文件頁數(shù)： 10/24頁
文件大?。?/td> 434K
代理商： VSC8114
VITESSE
Data Sheet
VSC8114
ATM/SONET/SDH 622 Mb/s Transceiver Mux/Demux
with Integrated Clock Generation and Clock Recovery
Page 10
VITESSE
SEMICONDUCTOR CORPORATION
741 Calle Plano, Camarillo, CA 93012 805/388-3700 FAX: 805/987-5896
G52185-0, Rev 4.0
11/1/99
Figure 10: Transmit High Speed Data Timing Diagram
Table 5: Transmit High Speed Data Timing Table
Figure 11: Transmit Data Timing Diagram
Table 6: Transmit Data Input Timing Table
Note: Duty cycle for TXLSCKOUT is 50% +/- 10% worst case
Parameter
Description
Min
Typ
Max
Units
T
TXDAT
Transmit data width
-
1.608
-
ns
Parameter
Description
Min
Typ
Max
Units
T
CLKIN
Transmit data input byte clock period
Transmit data and parity setup time with respect to
TXLSCKIN
Transmit data and parity hold time with respect to
TXLSCKIN
Maximum allowable propagation delay for connecting
TXLSCKOUT to TXLSCKIN
Propagation delay from TXLSCKIN to TXPERR
-
12.86
-
ns
T
INSU
1.0
-
-
ns
T
INH
1.0
-
-
ns
T
PROP
-
-
3.5
ns
T
ERR
3.2
-
9.0
ns
T
TXDAT
TXDATAOUT+
TXDATAOUT-
T
PROP
T
CLKIN
T
INSU
T
INH
TXLSCKOUT
TXLSCKIN
TXIN [7:0]
TXINP
TXPERR
T
ERR
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