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參數(shù)資料
| 型號： | UPD75236 |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 4位單片機 |
| 文件頁數(shù)： | 138/190頁 |
| 文件大?。?/td> | 1220K |
| 代理商： | UPD75236 |
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138
μ
PD75236
5.3
INTERRUPT SEQUENCE
If interrupt is generated, it is processed using the following procedure:
* 1.
IST1 and IST0 : Interrupt status flags (PSW bits 3, 2: Refer to
Table 5-3 IST1 and IST0 Interrupt Servicing
Statuses
).
The start address of the interrupt service program and the MBE and RBE set values at the start of
interrupt are stored in each vector table.
2.
NO
YES
NO
IME = 1
YES
NO
YES
NO
YES
YES
NO
*1
IST 1,0 = 00
Interrupt (INTXXX) generated
IRQXXX set
IEXXX set
Is VRQn
a high interrupt
*1
IST 1,0 = 00 or 01
Depends on the
instruction being
executed when
IRQn is set.
2 Machine
Cycles
PC and PSW contents are saved into the stack memory and the data
*2
in
the vector table corresponding to the started VRQn is set to PC, RBE and
MBE.
IST0 and IST1 contents are changed from 00
to 01 or from 01 to 10.
Acknowledged IRQXXX is reset.
(If the interrupt source shares the vector address,
refer to
5.5 VECTOR ADDRESS SHARING
INTERRUPT SERVICING.)
Interrupt service program processing start
Selected
VRQn
Remaining
VRQn
If two or more VRQn have been gene-
rated simultaneously, one VRQn is se-
lected according to the interrupt order
shown in Table 5-1.
Reserved until
termination of
operation being
executed
Reserved
until IME is
set
Reserved until
IEXXX is set
Corresponding VRQn
generated
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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