參數(shù)資料
型號： UPD720110AGC-8EA
廠商： NEC Corp.
英文描述： MOS INTEGRATED CIRCUIT
中文描述： 馬鞍山集成電路
文件頁數(shù)： 7/32頁
文件大?。?/td> 405K
代理商： UPD720110AGC-8EA
Data Sheet S15737EJ5V0DS
7
μ
PD720110A
(2/2)
Pin Name
I/O
Buffer Type
Active
Level
Function
PLLLOCK
O (I/O)
Output
Indication when PLL is locked
TS(1)
I
Input with 12 k
pull-down R
Test signal
TS(10:2)
I
Input
Test signal
TSO
I/O
I/O
Test signal
V
DD
V
DD
AV
DD
V
DD
for analog circuit
V
SS
V
SS
AV
SS
V
SS
for analog circuit
N.C.
Not connected
Remarks 1.
“5 V tolerant“ means that the buffer is 3 V buffer with 5 V tolerant circuit.
2.
The signal marked as “(I/O)” in the above table operates as I/O signals during testing. However,
they do not need to be considered in normal use.
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