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參數(shù)資料
| 型號： | UPD70F3107AGJA-UEN |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁數(shù)： | 69/99頁 |
| 文件大?。?/td> | 528K |
| 代理商： | UPD70F3107AGJA-UEN |
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CHAPTER 5 APPLICATION EXAMPLES
Application Note U17121EJ1V1AN
69
5.3 Example of Evaluation Board Connection Circuit
A circuit example of connection of the V850E/ME2 with SDRAM, FPGA, and a PCI device (slot) is shown below.
Figure 5-2. Example of Evaluation Board Connection Circuit
System reset
RESET
PCI bus clock
CS6
CS3
RD
RD
WAIT
INT0
INT1
INT2
HLDRQ
HLDAK
BUSCLK
SDCKE
SDRAS
SDCAS
WE
xxBE
xxWR
A0 to A25
V850E/ME2
A0 to A12
BA0, BA12
D0 to D31
DQM0, DQM1
CLK
CKE
CS
RAS
CAS
WE
DQM2,
DQM3
SDRAM
SDRAM
CSZ6
VBESTZ
RA0 to RA25
RD0 to RD25
BENZ0 to BENZ3
WRZ0 to WRZ3
RDZ
WAITZ
INT0
INT1
INT2
HLDRQZ
HLDAKZ
DQM0 to DQM3
SDCLK
SDCKE
SDCS
SDRASZ
SDCASZ
SDWEZ
PCLK
PCIRST
IRDY
DEVSEL
TRDY
STOP
PAR
PERR
SERR
REQ1
GNT1
INTA
CBE0 to CBE3
FRAME
AD0 to AD31
FPGA
(PCI host bridge)
RST#
AD0 to AD31
IDSEL#
C/BE#0 to C/BE#3
FRAME#
IRDY#
DEVSEL#
TRDY#
STOP#
PAR
PERR#
SERR#
REQ#
GNT#
INT#
CLK
PCI device
RST#
AD0 to AD31
IDSEL#
C/BE#0 to C/BE#3
FRAME#
IRDY#
DEVSEL#
TRDY#
STOP#
PAR
PERR#
SERR#
REQ#
GNT#
INT#
REQ2
GNT2
INTB
CLK
PCI device
A24, A25
A2 to A14
Remark
xx: LL, LU, UL, UU
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PDF描述 |
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參數(shù)描述 |
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