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參數資料
| 型號： | UPD44324092F5-E50-EQ2-A |
| 廠商： | NEC Corp. |
| 元件分類： | DRAM |
| 英文描述： | 36M-BIT DDRII SRAM 2-WORD BURST OPERATION |
| 中文描述： | 36M條位SRAM的2條DDRII字爆發(fā)運作 |
| 文件頁數： | 11/40頁 |
| 文件大?。?/td> | 361K |
| 代理商： | UPD44324092F5-E50-EQ2-A |
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11
Data Sheet M16780EJ3V0DS
μ
PD44324082, 44324092, 44324182, 44324362
2. Clock starts before V
DD
/V
DD
Q stable
The clock is supplied from a clock generator.
(a)
V
DD
/V
DD
Q
DLL#
30 ns. (MIN.)
Clock Stop
V
DD
/V
DD
Q Stable (<
±
0.1 V DC per 50 ns)
Fix high (or tied to V
DD
Q)
Unstable Clock
(level, frequency)
Clock
Clock Start
Normal Operation Start
1,024 cycles or more
Stable Clock
(b)
V
DD
/V
DD
Q
DLL#
Clock keep running
Switched to high after Clock is stable.
High or low
30 ns (MIN.)
DLL# low
V
DD
/V
DD
Q Stable (<
±
0.1 V DC per 50 ns)
Normal
Operation
Start
1,024 cycles or more
Stable Clock
Unstable Clock
(level, frequency)
Clock
Clock Start
相關PDF資料 |
PDF描述 |
|---|---|
| UPD44324182F5-E37-EQ2 | 36M-BIT DDRII SRAM 2-WORD BURST OPERATION |
| UPD44324182F5-E37-EQ2-A | 36M-BIT DDRII SRAM 2-WORD BURST OPERATION |
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| UPD44324362F5-E37-EQ2 | 36M-BIT DDRII SRAM 2-WORD BURST OPERATION |
相關代理商/技術參數 |
參數描述 |
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