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參數(shù)資料
| 型號： | UPD44324092F5-E37-EQ2 |
| 廠商： | NEC Corp. |
| 元件分類： | DRAM |
| 英文描述： | 36M-BIT DDRII SRAM 2-WORD BURST OPERATION |
| 中文描述： | 36M條位SRAM的2條DDRII字爆發(fā)運作 |
| 文件頁數(shù)： | 14/40頁 |
| 文件大小： | 361K |
| 代理商： | UPD44324092F5-E37-EQ2 |
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14
Data Sheet M16780EJ3V0DS
μ
PD44324082, 44324092, 44324182, 44324362
Bus Cycle State Diagram
READ DOUBLE
Count = Count + 2
WRITE DOUBLE
Count = Count + 2
Power UP
Write
NOP
Supply voltage provided
LOAD NEW
ADDRESS
Count = 0
NOP
Load, Count = 2
Read
Load, Count = 2
Load
NOP,
Count = 2
NOP,
Count = 2
Remarks 1.
A0 is internally advanced in accordance with the burst order table.
Bus cycle is terminated after burst count = 2.
2.
State machine control timing sequence is controlled by K.
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