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參數(shù)資料
| 型號： | UPD44164182F5-E40-EQ1 |
| 廠商： | NEC Corp. |
| 英文描述： | 18M-BIT DDRII SRAM 2-WORD BURST OPERATION |
| 中文描述： | 1800萬位的SRAM 2條DDRII字爆發(fā)運作 |
| 文件頁數(shù)： | 19/32頁 |
| 文件大小： | 282K |
| 代理商： | UPD44164182F5-E40-EQ1 |
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19
Data Sheet M15821EJ7V2DS
μ
PD44164082, 44164182, 44164362
JTAG AC Characteristics (T
A
= 0 to 70
°
C)
Parameter
Symbol
Conditions
MIN.
TYP.
MAX.
Unit
Note
Clock
Clock cycle time
t
THTH
100
–
–
ns
Clock frequency
f
TF
–
–
10
MHz
Clock high time
t
THTL
40
–
–
ns
Clock low time
t
TLTH
40
–
–
ns
Output time
TCK low to TDO unknown
t
TLOX
0
–
–
ns
TCK low to TDO valid
t
TLOV
–
–
20
ns
TDI valid to TCK high
t
DVTH
10
–
–
ns
TCK high to TDI invalid
t
THDX
10
–
–
ns
Setup time
TMS setup time
t
MVTH
10
–
–
ns
Capture setup time
t
CS
10
–
–
ns
Hold time
TMS hold time
t
THMX
10
–
–
ns
Capture hold time
t
CH
10
–
–
ns
JTAG Timing Diagram
t
THTH
t
TLOV
t
TLTH
t
THTL
t
MVTH
t
THDX
t
DVTH
t
THMX
TCK
TMS
TDI
TDO
t
TLOX
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD44164082F5-E50-EQ1 | 18M-BIT DDRII SRAM 2-WORD BURST OPERATION |
| UPD44164182F5-E50-EQ1 | 18M-BIT DDRII SRAM 2-WORD BURST OPERATION |
| UPD44164362F5-E50-EQ1 | 18M-BIT DDRII SRAM 2-WORD BURST OPERATION |
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| UPD44164182F5-E60-EQ1 | 18M-BIT DDRII SRAM 2-WORD BURST OPERATION |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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