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參數(shù)資料
| 型號： | TPS65950ZXNT |
| 廠商： | TEXAS INSTRUMENTS INC |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA209 |
| 封裝： | 7 X 7 MM, 0.40 MM PITCH, PLASTIC, BGA-209 |
| 文件頁數(shù)： | 8/167頁 |
| 文件大?。?/td> | 2566K |
| 代理商： | TPS65950ZXNT |
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UART_TX
DM
DP
UART_RX
CK1
CK2
CK3
CK4
032-053
7.2.3
HS USB Port Timing
UCLK
STP
DIR_&_NXT
DATA[7:0]
Data_OUT
Data_IN
HSU0
HSU3
HSU6
HSU7
HSU1
HSU4
HSU5
HSU2
032-054
TPS65950
Integrated Power Management/Audio Codec
www.ti.com
SWCS032 – OCTOBER 2008
Table 7-3. USB-CEA Carkit UART Timing Parameters
Notation
Parameter
Min(1) Max(2)
Unit
CK1
td(UART_TXH-DM)
Delay time, UART_TX rising edge to DM transition
4.0
11
ns
CK2
td(UART_TXL-DM)
Delay time, UART_TX falling edge to DM transition
4.0
11
ns
At 38.4 MHz
205
234
CK3
td(DPH-UART_RX)
Delay time, DP rising edge to UART_RX transition
ns
At 19.2 MHz
310
364
At 38.4 MHz
205
234
CK4
td(DPL-UART_RX)
Delay time, DP falling edge to UART_RX transition
ns
At 19.2 MHz
310
364
(1)
Min = Minimum value
(2)
Max = Maximum value
Figure 7-6 shows the USB-CEA carkit UART timings.
Figure 7-6. USB-CEA Carkit UART Timing Parameters
The ULPI interface supports an 8-bit data bus and the internal clock mode. The 4-bit data bus and the
external clock mode are not supported.
The HS functional mode supports an operating rate of 480 Mbps.
Figure 7-7. HS USB Interface—Transmit and Receive Modes (ULPI 8-Bit)
NOTE
ULPI data [7:0] lines are set to 1 after USB PHY power up, and before the clock signal is
stable.
The input timing requirements are given by considering a rising or falling time of 1 ns.
USB HS 2.0 OTG Transceiver
105
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