參數(shù)資料
型號(hào)： TMS320DM647_08
廠商： Texas Instruments, Inc.
英文描述： Digital Media Processor
中文描述： 數(shù)字媒體處理器
文件頁數(shù)： 62/167頁
文件大小： 1438K
代理商： TMS320DM647_08
www.ti.com
P
6.4 PLL1 and PLL1 Controller
1
0
DIVIDER D4
CLKIN1
PLLEN (PLLCTL.[0])
SYSCLK1
SYSCLK2
AECLKIN (External EMIF Clock Input)
EMIFA
DIVIDER PREDIV
DIVIDER D1
DIVIDER D2
AECLKOUT
PLLV1
C2
C1
EMI Filter
+1.8 V
560 pF 0.1 F
SYSCLK5
SYSREFCLK
(C64x+ MegaModule)
DIVIDER D5
PLL1 Controller
(EMIF Input Clock)
/1, /2, /3
ENA
PREDEN (PREDIV.[15])
/3
ENA
/2, /4,
..., /16
PLL1
PLLM
x1, x15,
x20, x25,
x30, x32
D4EN (PLLDIV4.[15])
SYSCLK4
(Internal EMIF Clock Input)
SYSCLK4
P
P
SYSCLK3
DIVIDER D3
/6
SYSCLK6
DIVIDER D6
ENA
D2EN (PLLDIV2.[15])
/1, /2,
..., /8
(Emulation and Trace)
VICP cop_clk/2
VICP cop_clk
/4
/2
0 1
AECLKINSEL
(AEA[17] pin)
1 0
VCLK
VLYNQ
CLKDIR
(CTRL.[15])
/1, /2,
CLKDIV
(CTRL.[18:16])
TMS320DM647/TMS320DM648
Digital Media Processor
SPRS372A–MAY 2007–REVISED JUNE 2007
RSV19 - connect this pin to ground (V
SS
) via a 200-
resistor.
RSV20 - connect this pin to the 1.8-V I/O supply (D
VDD18
) via a 200-
resistor
The primary PLL controller generates the input clock to the C64x+ megamodule (including the CPU) as
well as most of the system peripherals such as the multichannel audio serial ports (McASPs) and the
external memory interface (EMIFA).
Figure 6-5. PLL Input Clock
As shown in
Figure 6-5
, the PLL1 controller features a software-programmable PLL multiplier controller
Peripheral Information and Electrical Specifications
62
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