參數(shù)資料
型號(hào)： TMS320DM6443_07
廠商： Texas Instruments, Inc.
英文描述： Digital Media System-on-Chip
中文描述： 數(shù)字媒體系統(tǒng)片上
文件頁(yè)數(shù)： 142/221頁(yè)
文件大?。?/td> 1582K
代理商： TMS320DM6443_07
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www.ti.com
6.11.2 ATA/CF Electrical Data/Timing
TMS320DM6443
Digital Media System-on-Chip
SPRS282E–DECEMBER 2005–REVISED MARCH 2007
All ATA/CF AC timing data described in
Section 6.11.2.1
–
Section 6.11.2.3
is provided at the DM6443
device pins. For more details, see
Section 6.1
,
Parameter Information
.
The AC timing specifications described in
Section 6.11.2.1
–
Section 6.11.2.3
assume correct configuration
of the ATA/CF memory-mapped control registers for the selected ATA/CF frequency of operation.
6.11.2.1
ATA/CF PIO Data Transfer AC Timing
Table 6-39. Timings for ATA/CF Module — PIO Data Transfer
(1)(2)
(see
Figure 6-26
)
-594
MIN
NO.
UNIT
MODE
0-4
(3)
0-4
(3)
0-4
(3)
0-2
3-4
(3)
MAX
1
2
3
t
0
t
1
t
2
Cycle time
Address valid to DIOW/ DIOR setup
DIOW/ DIOR pulse duration low
(DATSTB + DATRCVR + 2)P -0.5
12P - 1.6
(DATSTB + 1)P - 1
–
(DATRCVR + 1)P - 1
ns
ns
ns
ns
ns
4
t
2i
DIOW/DIOR recovery time, pulse duration high
DIOW data setup time, DD[15:0] valid before
DIOW rising edge
DIOW data hold time, DD[15:0] valid after DIOW
rising edge
5
t
3
0-4
(3)
(DATSTB + 1)P
ns
6
t
4
0-4
(3)
(HWNHLD + 1)P + 1
ns
0
1
50
35
20
ns
ns
ns
DIOR data setup time, DD[15:0] valid before DIOR
rising edge
7
t
5
2-4
(3)
DIOR data hold time, DD[15:0] valid after DIOR
rising edge
Output data 3-state, DD[15:0] 3-state after DIOR
rising edge
DIOW/DIOR to address valid hold
Read data setup time, DD[15:0] valid before
IORDY active
IORDY setup
IORDY pulse width
IORDY assertion to release
8
t
6
0-4
(3)
5
ns
9
t
6Z
0-4
(3)
30
ns
10
t
9
0-4
(3)
(HWNHLD + 1)P - 2.1
ns
11
t
RD
0-4
(3)
0
ns
12
13
14
t
A
t
B
t
C
0-4
(3)(4)
0-4
(3)
0-4
(3)
35
ns
ns
ns
1250
5
(1)
(2)
P = SYSCLK5 period, in ns, for ATA. For example, when running the DSP CPU at 594 MHz, use P = 10.1 ns.
DATSTB equals the value programmed in the DATSTBxP bit field in the DATSTB register. DATRCVR equals the value programmed in
the DATRCVRxP bit field in the DATRCVR register. HWNHLD equals the value programmed in the HWNHLDxP bit field in the
MISCCTL register. For more detailed information, see the
TMS320DM644x DMSoC ATA Controller User's Guide
(literature number
SPRUE21
).
The sustained throughput for PIO modes 3 and 4 is limited to the throughput equivalent of PIO mode 2. For more detailed information,
see the
TMS320DM644x DMSoC ATA Controller User's Guide
(literature number
SPRUE21
).
The t
parameter must be met only when the IORDY timer is enabled to allow a device to insert wait states during a transaction. In order
to meet the t
A
parameter, a minimum frequency for SYSCLK5 is specified for each PIO as follows:
PIO mode 0, MIN frequency = 15 MHz
PIO mode 1, MIN frequency = 22 MHz
PIO mode 2, MIN frequency = 31 MHz
PIO mode 3, MIN frequency = 45 MHz
PIO mode 4, MIN frequency = 57 MHz
(3)
(4)
Peripheral and Electrical Specifications
142
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相關(guān)PDF資料
PDF描述
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TMS320DM6443BZWTB 制造商:Texas Instruments 功能描述:DAVINCI DIGITAL MEDIA SYSTEM-ON-CHIP - Trays
TMS320DM6443ZWT 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC Dig Media System- on-Chip RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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