參數(shù)資料
型號(hào)： TLC876MDW
廠商： Texas Instruments, Inc.
英文描述： 10-BIT 20 MSPS PARALLEL OUTPUT CMOS ANALOG-TO-DIGITAL CONVERTERS
中文描述： 10位20 MSPS的并行輸出CMOS模擬數(shù)字轉(zhuǎn)換器
文件頁(yè)數(shù)： 8/23頁(yè)
文件大小： 314K
代理商： TLC876MDW
TLC876M TLC876I, TLC876C
10-BIT 20 MSPS PARALLEL OUTPUT CMOS
ANALOG-TO-DIGITAL CONVERTERS
SLAS140D – JULY 1997 – REVISED MAY 2000
8
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
operating characteristics at AV
DD
= DV
DD
= 5 V, DRV
DD
= 3.3 V, V
I(REFT)
= 3.6 V, V
I(REFB)
= 1.6 V,
f
CLK
= 20 MSPS (unless otherwise noted)
timing requirements
PARAMETER
TEST CONDITIONS
MIN
TYP
MAX
UNIT
fconv
td(o)
Maximum conversion rate (see Note 2)
20
MHz
Delay time, output
CL = 20 pF
5
20
ns
td(pipe)
Delay time, pipeline, latency
3.5
Clock
cycles
td(A)
Delay time, aperture
4
ns
Aperture jitter
Disable time, OE
↑
to Hi-Z
Enable time, OE
↓
to valid data
NOTE 2: The conversion rate can be a minimum of 10 kHz without degradation in specified performance.
22
ps
tdis(DD)
ten(HL)
CL= 20 pF
CL = 20 pF
5
5
15
15
ns
ns
PARAMETER MEASUREMENT INFORMATION
D0 – D9
Data N–4
Data N–3
Data N–2
Data N–1
Data N
tc
tw(CLKH)
tw(CLKL)
Sample N
Sample N+1
Sample N+2
AIN
CLK
td(o)
td(pipe)
td(A)
td(o)
Figure 1. Timing Diagram
tdis(DD)
ten(HL)
High Impedance
Active
OE
D0–D9
Figure 2. Output Enable to Data Output Timing Diagram
STBY
CLK
Output Data Valid
Figure 3. Standby Timing
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PDF描述
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TLE2024(中文) Quad,Precision, High-Speed, Low-Power Operational Amplifiers(四路精密型，低功耗，單電源運(yùn)放)
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