參數(shù)資料
型號(hào)： ST95022M3TR
廠商： 意法半導(dǎo)體
元件分類： DRAM
英文描述： 2 Kbit Serial SPI EEPROM with High Speed Clock
中文描述： 2千位的SPI EEPROM，帶有高速時(shí)鐘
文件頁(yè)數(shù)： 5/16頁(yè)
文件大小： 113K
代理商： ST95022M3TR
AI01272
HOLD
S
W
Control Logic
High Voltage
Generator
I/O Shift Register
Address Register
and Counter
Data
Register
16 Bytes
X Decoder
Y
Block
Protect
C
D
Q
Status
Figure 5. Block Diagram
tected blocks. The blocks and respective WRSR
control bits are shown in Table 4.
When the WRSR instruction and the 8 bits of the
Status Register are latched-in, the internal write
cycle is then triggered by the rising edge of S.
This rising edge of S must appear no later than the
16th clock cycle of the WRSR instruction of the
Status Register content (it must not appear a 17th
clock pulse before the rising edge of S), otherwise
the internal write sequence is not performed.
Status Register
Bits
Array
Addresses
Protected
Protected
Block
BP1
BP0
0
0
none
none
0
1
C0h - FFh
Upper quarter
1
0
80h - FFh
Upper half
1
1
00h - FFh
Whole memory
Table 4. Write Protected Block Size
5/16
ST95022
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