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參數(shù)資料
| 型號(hào)： | ST901T |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | HIGH VOLTAGE IGNITION COIL DRIVER NPN POWER DARLINGTON |
| 中文描述： | 高壓點(diǎn)火線圈驅(qū)動(dòng)達(dá)林頓NPN電源 |
| 文件頁數(shù)： | 137/199頁 |
| 文件大小： | 2813K |
| 代理商： | ST901T |
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137/199
ST90158 - SERIAL PERIPHERAL INTERFACE (SPI)
SERIAL PERIPHERAL INTERFACE
(Cont’d)
9.5.5 Working With Other Protocols
The SPI peripheral offers the following facilities for
operation with S-bus/I
2
C-bus and IM-bus proto-
cols:
I
Interrupt request on start/stop detection
I
Hardware clock synchronisation
I
Arbitration lost flag with an automatic set of data
line
Note that the I/O bit associated with the SPI should
be returned to a defined state as a normal I/O pin
before changing the SPI protocol.
The following paragraphs provide information on
how to manage these protocols.
9.5.6 I
2
C-bus Interface
The I
2
C-bus is a two-wire bidirectional data-bus,
the two lines being SDA (Serial DAta) and SCL
(Serial CLock). Both are open drain lines, to allow
arbitration. As shown in
Figure 69
, data is toggled
with clock low. An I2C bus start condition is the
transition on SDI from 1 to 0 with the SCK held
high. In a stop condition, the SCK is also high and
the transition on SDI is from 0 to 1. During both of
these conditions, if SPEN = 0 and BMS = 1 then
an interrupt request is performed.
Each transmission consists of nine clock pulses
(SCL line). The first 8 pulses transmit the byte
(MSB first), the ninth pulse is used by the receiver
to acknowledge.
Figure 68. S-Bus / I
2
C-bus Peripheral
Compatibility without S-Bus Chip Select
9
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