參數(shù)資料
型號(hào)： SN54ALVTH16646
廠商： Texas Instruments, Inc.
英文描述： 2.5-V/3.3-V 16-Bit Bus Transceivers With 3-State Outputs( 2.5V/3.3V 16位總線收發(fā)器(三態(tài)輸出))
中文描述： 2.5-V/3.3-V 16位總線收發(fā)器三態(tài)輸出（2.5V/3.3V的16位總線收發(fā)器（三態(tài)輸出））
文件頁(yè)數(shù)： 8/12頁(yè)
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代理商： SN54ALVTH16646
SN54ALVTH16646, SN74ALVTH16646
2.5-V/3.3-V 16-BIT BUS TRANSCEIVERS
WITH 3-STATE OUTPUTS
SCES072A – JUNE 1996 – REVISED JULY 1996
8
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
timing requirements over recommended operating free-air temperature range, V
CC
= 2.5 V
±
0.2 V
(unless otherwise noted) (see Figure 2)
SN54ALVTH16646
MIN
SN74ALVTH16646
MIN
UNIT
MAX
MAX
fclock
tw
Clock frequency
0
150
0
150
MHz
Pulse duration, CLK high or low
1.5
1.5
ns
tsu
Setup time A or B before CLKAB
Setup time, A or B before CLKAB
↑
or CLKBA
↑
Data high
2.5
2.5
ns
Data low
2.6
2.6
th
Hold time A or B after CLKAB
Hold time, A or B after CLKAB
↑
or CLKBA
↑
Data high
Data low
0
0
0
0
ns
timing requirements over recommended operating free-air temperature range, V
CC
= 3.3 V
±
0.3 V
(unless otherwise noted) (see Figure 3)
SN54ALVTH16646
SN74ALVTH16646
UNIT
MIN
MAX
MIN
MAX
fclock
tw
Clock frequency
0
150
0
150
MHz
Pulse duration, CLK high or low
1.5
1.5
ns
tsu
Setup time A or B before CLKAB
Setup time, A or B before CLKAB
↑
or CLKBA
↑
Data high
2.1
2.1
ns
Data low
2.2
2.2
th
Hold time A or B after CLKAB
Hold time, A or B after CLKAB
↑
or CLKBA
↑
Data high
Data low
0
0
0
0
ns
P
相關(guān)PDF資料
PDF描述
SN74ALVTH16646 2.5-V/3.3-V 16-Bit Bus Transceivers With 3-State Outputs( 2.5V/3.3V16位總線收發(fā)器(三態(tài)輸出))
SN54ALVTH16821WD 2.5-V/3.3-V 20-BIT BUS-INTERFACE FLIP-FLOPS WITH 3-STATE OUTPUTS
SN74ALVTH16821DGG 2.5-V/3.3-V 20-BIT BUS-INTERFACE FLIP-FLOPS WITH 3-STATE OUTPUTS
SN74ALVTH16821DGV 2.5-V/3.3-V 20-BIT BUS-INTERFACE FLIP-FLOPS WITH 3-STATE OUTPUTS
SN54ALVTH16821 2.5-V/3.3-V 20-Bit Bus-Interface Flip-Flops(2.5V/3.3V 20位總線接口觸發(fā)器(三態(tài)輸出))
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參數(shù)描述
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