參數(shù)資料
型號(hào)： SH7708R
元件分類： 微控制器/微處理器
英文描述： 32-BIT, RISC MICROCONTROLLER, PQFP144
封裝： PLASTIC, LQFP-144
文件頁數(shù)： 246/625頁
文件大小： 3988K
代理商： SH7708R
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18
SSR
Saved Status Register (SSR)
Stores current SR value at time of exception to indicate processor
status in return to instruction stream from exception handler.
Its contents are undefined after a reset.
Saved Program Counter (SPC)
Stores current PC value at time of exception to indicate return
address at completion of exception handling.
Its contents are undefined after a reset.
Global Base Register (GBR)
Stores base address of GBR-indirect addressing mode.
The GBR-indirect addressing mode is used for on-chip supporting
module register area data transfers and logic operations.
The GBR register can also be accessed in user mode.
Its contents are undefined after a reset.
Vector Base Register (VBR)
Stores base address of exception handling vector area.
Initialized to H'0000000 by a reset.
31
0
SPC
31
0
GBR
31
0
VBR
31
0
MD
BL
M Q
0––––––––––––––––––––––––––––0
I3 I2 I1 I0 0 0 S T
Status
register
(SR)
31
29 28 27
10 9 8 7
0
1
3
0RB
30
MD:
RB:
BL:
M and Q bits:
I3–I0 bits:
S bit:
T bit:
0 bits:
Processor operation mode bit: Indicates the processor operation mode as follows:
MD =1: Privileged mode; MD = 0: User mode
MD is set to 1 on generation of an exception or interrupt , and is initialized to 1 by a reset.
Register bank bit: Determines the bank of general registers R0–R7 used in processing mode.
RB = 1: R0_BANK1–R7_BANK1 and R8–R15 are general registers, and R0_BANK0–
R7_BANK0 can be accessed by LDC/STC instructions.
RB = 0: R0_BANK0–R7_BANK0 and R8–R15 are general registers, and R0_BANK1–
R7_BANK1 can be accessed by LDC/STC instructions.
RB is set to 1 on generation of an exception or interrupt , and is initialized to 1 by a reset.
Block bit
BL = 1: Exceptions and interrupts are suppressed. See section 4, Exception
Handling, for details.
BL = 0: Exceptions and interrupts are accepted.
BL is set to 1 on generation of an exception or interrupt , and is initialized to 1 by a reset.
Used by the DIV0S/U and DIV1 instructions.
Interrupt mask bits: 4-bit field indicating the interrupt request mask level.
I3–I0 do not change to the interrupt acceptance level when an interrupt is generated.
Initialized to B'1111 by a reset.
Used by the MAC instruction.
Used by the MOVT, CMP/cond, TAS, TST, BT, BF, SETT, CLRT, and DT instructions to
indicate true (1) or false (0).
Used by the ADDV/C, SUBV/C, DIV0U/S, DIV1, NEGC, SHAR/L, SHLR/L, ROTR/L, and
ROTCR/L instructions to indicate a carry, borrow, overflow, or underflow.
These bits always read 0, and the write value should always be 0.
Note: The M, Q, S, and T bits can be set or cleared by special instructions in user mode.
Their values are undefined after a reset. All other bits can be read or written in privileged mode.
Figure 2.5
Register Set Overview, Control Registers
相關(guān)PDF資料
PDF描述
SI5327D-C-GMR 243 MHz, PROC SPECIFIC CLOCK GENERATOR, QCC36
SI5334B-A00122-GM PLL BASED CLOCK DRIVER, QCC24
SI5334C-A00129-GMR PLL BASED CLOCK DRIVER, QCC24
SI5334C-A00153-GM PLL BASED CLOCK DRIVER, QCC24
SI5334C-A00160-GM PLL BASED CLOCK DRIVER, QCC24
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
SH7708S 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine
SH7712 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas 32-Bit RISC Microcomputer SuperHTM RISC engine Family / SH7700 Series
SH7727WCE-RP7 制造商:Renesas Electronics Corporation 功能描述:Dev Reference Platform SH7727 制造商:Renesas Electronics Corporation 功能描述:H-SUPPORT TOOL - Bulk
SH7729 制造商:HITACHI 制造商全稱:Hitachi Semiconductor 功能描述:Hitachi Microcomputer Development Environment System
SH7729R 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas 32-Bit RISC Microcomputer Super RISC engine Family/SH7700 Series
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