參數(shù)資料
型號： PIC16LF877T-20/PT
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP44
封裝： 10 X 10 MM, 1 MM HEIGHT, PLASTIC, TQFP-44
文件頁數(shù)： 33/200頁
文件大小： 1378K
代理商： PIC16LF877T-20/PT
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PIC16F87X
DS30292A-page 128
Preliminary
1998 Microchip Technology Inc.
11.4
A/D Conversions
Example 11-1 shows how to perform an A/D conver-
sion. The analog pins are congured as analog inputs.
The analog references (VREF) are the device VDD and
VSS. The A/D interrupt is enabled, and the A/D conver-
sion clock is FRC, with the result being left justied. The
conversion is performed on the RA0/AN0 pin (channel
0).
Clearing the GO/DONE bit during a conversion will
abort the current conversion. The A/D result register
pair will NOT be updated with the partially completed
A/D conversion sample. That is, the ADRESH:ADRESL
registers will continue to contain the value of the last
completed conversion (or the last value written to the
ADRESH:ADRESL registers). After the A/D conversion
is aborted, a 2TAD wait is required before the next
acquisition is started. After this 2TAD wait, acquisition
on the selected channel is automatically started.
In Figure 11-6, after the GO bit is set, the rst time seg-
mant has a minimum of TCY and a maximum of TAD.
EXAMPLE 11-1: A/D CONVERSION
FIGURE 11-6: A/D CONVERSION TAD CYCLES
Note:
The GO/DONE bit should NOT be set in
the same instruction that turns on the A/D.
BSF
STATUS, RP0
; Select Bank 1
BCF
STATUS, RP1
;
CLRF
ADCON1
; Configure A/D inputs
BSF
PIE1,
ADIE
; Enable A/D interrupts
BCF
STATUS, RP0
; Select Bank 0
MOVLW
11000001
; RC Clock, A/D is on, Channel 0 is selected
MOVWF
ADCON0
;
BCF
PIR1,
ADIF
; Clear A/D interrupt flag bit
BSF
INTCON, PEIE
; Enable peripheral interrupts
BSF
INTCON, GIE
; Enable all interrupts
;
Ensure that the required sampling time for the selected input channel has elapsed.
;
Then the conversion may be started.
;
BSF
ADCON0, GO
; Start A/D Conversion
:
; The ADIF bit will be set and the GO/DONE bit
:
;
is cleared upon completion of the A/D Conversion.
TAD1 TAD2 TAD3 TAD4 TAD5 TAD6 TAD7 TAD8 TAD9
Set GO bit
Holding capacitor is disconnected from analog input (typically 100 ns)
holding capacitor is connected to analog input.
b9
b8
b7
b6
b5
b4
b3
b2
TAD10 TAD11
b1
b0
Tcy to TAD
GO bit is cleared,
Next Q4: ADRES is loaded,
ADIF bit is set,
Conversion Starts
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