參數(shù)資料
型號： PIC16LF877T-20/PT
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP44
封裝： 10 X 10 MM, 1 MM HEIGHT, PLASTIC, TQFP-44
文件頁數(shù)： 128/200頁
文件大小： 1378K
代理商： PIC16LF877T-20/PT
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PIC16F87X
1998 Microchip Technology Inc.
Preliminary
DS30292A-page 33
3.3
PORTC and the TRISC Register
PORTC is an 8-bit wide bi-directional port. The corre-
sponding data direction register is TRISC. Setting a
TRISC bit (=1) will make the corresponding PORTC pin
an input, i.e., put the corresponding output driver in a
hi-impedance mode. Clearing a TRISC bit (=0) will
make the corresponding PORTC pin an output, i.e., put
the contents of the output latch on the selected pin.
PORTC is multiplexed with several peripheral functions
(Table 3-5). PORTC pins have Schmitt Trigger input
buffers.
When the I2C module is enabled, the PORTC (3:4) pins
can be congured with normal I2C levels or with
SMBUS levels by using the CKE bit (SSPSTAT <6>).
When enabling peripheral functions, care should be
taken in dening TRIS bits for each PORTC pin. Some
peripherals override the TRIS bit to make a pin an out-
put, while other peripherals override the TRIS bit to
make a pin an input. Since the TRIS bit override is in
effect while the peripheral is enabled, read-modify-
write instructions (BSF, BCF, XORWF) with TRISC as
destination should be avoided. The user should refer to
the corresponding peripheral section for the correct
TRIS bit settings.
EXAMPLE 3-1:
INITIALIZING PORTC
BCF
STATUS, RP0
; Select Bank 0
CLRF
PORTC
; Initialize PORTC by
; clearing output
; data latches
BSF
STATUS, RP0
; Select Bank 1
MOVLW
0xCF
; Value used to
; initialize data
; direction
MOVWF
TRISC
; Set RC<3:0> as inputs
; RC<5:4> as outputs
; RC<7:6> as inputs
FIGURE 3-5: PORTC BLOCK DIAGRAM
(PERIPHERAL OUTPUT
OVERRIDE) RC<0:2> RC<5:7>
FIGURE 3-6: PORTC BLOCK DIAGRAM
(PERIPHERAL OUTPUT
OVERRIDE) RC<3:4>
PORT/PERIPHERAL Select(2)
Data bus
WR
PORT
WR
TRIS
RD
Data Latch
TRIS Latch
RD TRIS
Schmitt
Trigger
Q
D
Q
CK
Q
D
EN
Peripheral Data Out
0
1
Q
D
Q
CK
P
N
VDD
VSS
PORT
Peripheral
OE(3)
Peripheral input
I/O
pin(1)
Note 1:
I/O pins have diode protection to VDD and VSS.
2:
Port/Peripheral select signal selects between port
data and peripheral output.
3:
Peripheral OE (output enable) is only activated if
peripheral select is active.
PORT/PERIPHERAL Select(2)
Data bus
WR
PORT
WR
TRIS
RD
Data Latch
TRIS Latch
RD TRIS
Schmitt
Trigger
Q
D
Q
CK
Q
D
EN
Peripheral Data Out
0
1
Q
D
Q
CK
P
N
VDD
VSS
PORT
Peripheral
OE(3)
SSPl input
I/O
pin(1)
Note 1:
I/O pins have diode protection to VDD and VSS.
2:
Port/Peripheral select signal selects between port
data and peripheral output.
3:
Peripheral OE (output enable) is only activated if
peripheral select is active.
0
1
CKE
SSPSTAT<6>
Schmitt
Trigger
with
SMBus
levels
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