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參數(shù)資料
| 型號： | PD780138(A1) |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-Bit Single-Chip Microcontrollers |
| 中文描述： | 8位單芯片微控制器 |
| 文件頁數(shù)： | 382/558頁 |
| 文件大小： | 4436K |
| 代理商： | PD780138(A1) |
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CHAPTER 19 STANDBY FUNCTION
User’s Manual U16228EJ2V0UD
382
19.1.2 Registers controlling standby function
The standby function is controlled by the following two registers.
Oscillation stabilization time counter status register (OSTC)
Oscillation stabilization time select register (OSTS)
Remark
For the registers that start, stop, or select the clock, see
CHAPTER 5 CLOCK GENERATOR
.
(1) Oscillation stabilization time counter status register (OSTC)
This is the status register of the X1 input clock oscillation stabilization time counter. If the Ring-OSC clock is used
as the CPU clock, the X1 input clock oscillation stabilization time can be checked.
OSTC can be read by a 1-bit or 8-bit memory manipulation instruction.
Reset release (reset by RESET input, POC, LVI, clock monitor, and WDT), the STOP instruction, MSTOP (bit 7 of
MOC register) = 1, and MCC (bit 7 of PCC register) = 1 clear OSTC to 00H.
Figure 19-1. Format of Oscillation Stabilization Time Counter Status Register (OSTC)
Address: FFA3H After reset: 00H R
Symbol
7
6
5
4
3
2
1
0
OSTC
0
0
0
MOST11
MOST13
MOST14
MOST15
MOST16
MOST11
MOST13
MOST14
MOST15
MOST16
Oscillation stabilization time status
1
0
0
0
0
2
11
/f
X
min. (204.8
μ
s min.)
1
1
0
0
0
2
13
/f
X
min. (819.2
μ
s min.)
1
1
1
0
0
2
14
/f
X
min. (1.64 ms min.)
1
1
1
1
0
2
15
/f
X
min. (3.27 ms min.)
1
1
1
1
1
2
16
/f
X
min. (6.55 ms min.)
Cautions 1. After the above time has elapsed, the bits are set to 1 in order from MOST11 and
remain 1.
2. If the STOP mode is entered and then released while the Ring-OSC clock is
being used as the CPU clock, set the oscillation stabilization time as follows.
Desired OSTC oscillation stabilization time
≤
Oscillation stabilization time
set by OSTS
The X1 oscillation stabilization time counter counts only during the oscillation
stabilization time set by OSTS. Therefore, note that only the statuses during the
oscillation stabilization time set by OSTS are set to OSTC after STOP mode has
been released.
3. The wait time when STOP mode is released does not include the time after
STOP mode release until clock oscillation starts (“a” below) regardless of
whether STOP mode is released by RESET input or interrupt generation.
a
STOP mode release
X1 pin voltage
waveform
Remarks 1.
Values in parentheses are reference value for operation with f
X
= 10 MHz.
2.
f
X
: X1 input clock oscillation frequency
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