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參數(shù)資料
| 型號： | P3S12XEP100J1VAA |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 115/1036頁 |
| 文件大?。?/td> | 3356K |
| 代理商： | P3S12XEP100J1VAA |
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Chapter 2 Port Integration Module (S12XEPIMV1)
MC9S12XE-Family Reference Manual Rev. 1.07
Freescale Semiconductor
115
2.3.21
Port T Data Register (PTT)
2.3.22
Port T Input Register (PTIT)
Address 0x0240
Access: User read/write
1
1
Read: Anytime.
Write: Anytime.
7
6
5
4
3
2
1
0
R
PTT7
PTT6
PTT5
PTT4
PTT3
PTT2
PTT1
PTT0
W
Altern.
Function
IOC7
IOC6
IOC5
IOC4
IOC3
IOC2
IOC1
IOC0
—
—
VREG_API
—
—
—
—
—
Reset
0
0
0
0
0
0
0
0
Figure 2-19. Port T Data Register (PTT)
Table 2-19. PTT Register Field Descriptions
Field
Description
7-6
PTT
Port T general purpose input/output data
—Data Register
Port T pins 7 through 0 are associated with ECT channels IOC7 and IOC6.
When not used with the alternative function, these pins can be used as general purpose I/O.
If the associated data direction bit of this pin is set to 1, a read returns the value of the port register, otherwise the
buffered pin input state is read.
5
PTT
Port T general purpose input/output data
—Data Register
Port T pins 5 is associated with ECT channel IOC5 and the VREG_API output.
The ECT function takes precedence over the VREG_API and the general purpose I/O function if the related channel
is enabled.
When not used with the alternative function, these pins can be used as general purpose I/O.
If the associated data direction bit of this pin is set to 1, a read returns the value of the port register, otherwise the
buffered pin input state is read.
4-0
PTT
Port T general purpose input/output data
—Data Register
Port T pins 4 through 0 are associated with ECT channels IOC4 through IOC0.
When not used with the alternative function, these pins can be used as general purpose I/O.
If the associated data direction bit of this pin is set to 1, a read returns the value of the port register, otherwise the
buffered pin input state is read.
Address 0x0241
Access: User read
1
7
6
5
4
3
2
1
0
R
PTIT7
PTIT6
PTIT5
PTIT4
PTIT3
PTIT2
PTIT1
PTIT0
W
Reset
u
u
u
u
u
u
u
u
= Unimplemented or Reserved
u = Unaffected by reset
Figure 2-20. Port T Input Register (PTIT)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| P3S12XEP100J1VAAR | Microcontrollers |
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| P3S12XEP100J1VALR | Microcontrollers |
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參數(shù)描述 |
|---|---|
| P3S12XEP100J1VAAR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1VAG | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1VAGR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1VAL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1VALR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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