參數(shù)資料
型號(hào)： MSC8112TVT2400V
廠商： Freescale Semiconductor
文件頁數(shù)： 10/44頁
文件大?。?/td> 0K
描述： DSP DUAL CORE 431-FCPBGA
標(biāo)準(zhǔn)包裝： 60
系列： StarCore
類型： SC140 內(nèi)核
接口： 以太網(wǎng)，I²C，TDM，UART
時(shí)鐘速率： 300MHz
非易失內(nèi)存： 外部
芯片上RAM： 448kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.10V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 431-BFBGA，F(xiàn)CBGA
供應(yīng)商設(shè)備封裝： 431-FCPBGA（20x20）
包裝： 托盤
MSC8112 Dual Core Digital Signal Processor Data Sheet, Rev. 1
Electrical Characteristics
Freescale Semiconductor
18
2.5.3
Clock and Timing Signals
The following sections include a description of clock signal characteristics. Table 7 shows the maximum frequency values for
internal (Core, Reference, Bus, and DSI) and external (CLKIN and CLKOUT) clocks. The user must ensure that maximum
frequency values are not exceeded.
2.5.4
Reset Timing
The MSC8112 has several inputs to the reset logic:
Power-on reset (PORESET)
External hard reset (HRESET)
External soft reset (SRESET)
Software watchdog reset
Bus monitor reset
Host reset command through JTAG
All MSC8112 reset sources are fed into the reset controller, which takes different actions depending on the source of the reset.
The reset status register indicates the most recent sources to cause a reset. Table 10 describes the reset sources.
Table 7. Maximum Frequencies
Characteristic
Maximum in MHz
Core frequency
300
Reference frequency (REFCLK)
100
Internal bus frequency (BLCK)
100
DSI clock frequency (HCLKIN)
HCLKIN
≤ (min{70 MHz, CLKOUT})
External clock frequency (CLKIN or CLKOUT)
100
Table 8. Clock Frequencies
Characteristics
Symbol
Min
Max
CLKIN frequency
FCLKIN
20
100
BCLK frequency
FBCLK
40
100
Reference clock (REFCLK) frequency
FREFCLK
40
100
Output clock (CLKOUT) frequency
FCLKOUT
40
100
SC140 core clock frequency
FCORE
200
300
Note:
The rise and fall time of external clocks should be 3 ns maximum
Table 9. System Clock Parameters
Characteristic
Min
Max
Unit
Phase jitter between BCLK and CLKIN
—
0.3
ns
CLKIN frequency
20
MHz
CLKIN slope
—3
ns
CLKIN period jitter1
—
150
ps
CLKIN jitter spectrum
150
—
KHz
PLL input clock (after predivider)
20
100
MHz
PLL output frequency (VCO output)
800
1200
MHz
CLKOUT frequency jitter1
—
200
ps
CLKOUT phase jitter1 with CLKIN phase jitter of ±100 ps.
—
500
ps
Notes:
1.
Peak-to-peak.
2.
Not tested. Guaranteed by design.
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