參數(shù)資料
型號(hào)： mPD705101GM-100-8ED
廠商： NEC Corp.
英文描述： V831TM 32-BIT MICROPROCESSOR
中文描述： V831TM 32位微處理器
文件頁(yè)數(shù)： 46/72頁(yè)
文件大?。?/td> 302K
代理商： MPD705101GM-100-8ED
μ
PD705101
46
(3) Reset timing
Parameter
Symbol
Conditions
MIN.
MAX.
Unit
RESET hold time (vs. V
DD
VALID) <11>
t
HVR
2
μ
s
RESET setup time (vs. BCLK
↑
)
<12>
t
SRK
7
ns
RESET hold time (vs. BCLK
↑
)
<13>
T
HKR
7
ns
RESET pulse low-level width
<14>
t
WRL
Note 1
20
ms
Note 2
10
ms
Note 3
25
t
CYK
Notes 1.
At power application or when returned from STOP mode, and the internal clock is generated.
2.
At power application or when returned from STOP mode, and the internal clock is generated, after clock
has stabilized.
3.
When clock has stabilized under conditions other than Notes 1 and 2.
Remark
It is not necessary to satisfy t
SRK
and t
HKR
if reset during the period of t
HVR
. In such a case, however,
the reset acknowledge timing may be shifted.
<12>
<13>
<11>
<12>
<14>
0.9 V
DD
V
DD
CLKOUT (output)
RESET (input)
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PDF描述
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