MCF547x ColdFire Microprocessor, Rev. 4 Freescale Semiconductor 15 Fig" />
參數(shù)資料
型號(hào)： MCF5474ZP266
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 7/34頁(yè)
文件大?。?/td> 0K
描述： IC MPU 32BIT COLDF 388-PBGA
標(biāo)準(zhǔn)包裝： 40
系列： MCF547x
核心處理器： Coldfire V4E
芯體尺寸： 32-位
速度： 266MHz
連通性： EBI/EMI，以太網(wǎng)，I²C，SPI，UART/USART，USB
外圍設(shè)備： DMA，PWM，WDT
輸入/輸出數(shù)： 99
程序存儲(chǔ)器類型： ROMless
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 1.43 V ~ 1.58 V
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 388-BBGA
包裝： 托盤
SDRAM Bus
MCF547x ColdFire Microprocessor, Rev. 4
Freescale Semiconductor
15
Figure 12. FlexBus Write Timing
9
SDRAM Bus
The SDRAM controller supports accesses to main SDRAM memory from any internal master. It supports standard SDRAM or
double data rate (DDR) SDRAM, but it does not support both at the same time. The SDRAM controller uses SSTL2 and SSTL3
I/O drivers. Both SSTL drive modes are programmable for Class I or Class II drive strength.
9.1
SDR SDRAM AC Timing Characteristics
The following timing numbers indicate when data is latched or driven onto the external bus, relative to the memory bus clock,
when operating in SDR mode on write cycles and relative to SDR_DQS on read cycles. The MCF54
7x SDRAM controller is
a DDR controller that has an SDR mode. Because it is designed to support DDR, a DQS pulse must be supplied to the MCF54
7x
for each data beat of an SDR read. The MCF54
7x accomplishes this by asserting a signal called SDR_DQS during read cycles.
Care must be taken during board design to adhere to the following guidelines and specs with regard to the SDR_DQS signal
and its usage.
CLKIN
AD[X:0]
AD[31:Y]
R/W
ALE
TSIZ[1:0]
FBCSn, BE/BWEn
TA
FB1
A[X:0]
A[31:Y]
DATA
FB2
FB3
TSIZ[1:0]
FB3
FB6
FB7
OE
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