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參數(shù)資料
| 型號(hào)： | MCF5270CVM150 |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 352/626頁(yè) |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 150MHZ 196-MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 126 |
| 系列： | MCF527x |
| 核心處理器： | Coldfire V2 |
| 芯體尺寸： | 32-位 |
| 速度： | 150MHz |
| 連通性： | EBI/EMI，以太網(wǎng)，I²C，SPI，UART/USART |
| 外圍設(shè)備： | DMA，WDT |
| 輸入/輸出數(shù)： | 97 |
| 程序存儲(chǔ)器類型： | ROMless |
| RAM 容量： | 64K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.4 V ~ 1.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 196-LBGA |
| 包裝： | 托盤(pán) |
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Memory Map/Register Definition
MCF5271 Reference Manual, Rev. 2
Freescale Semiconductor
22-7
22.2.9 DMA Timer Reference Registers (DTRRn)
Each DTRRn, shown in Figure 22-5, contains the reference value compared with the respective
free-running timer counter (DTCNn) as part of the output-compare function. The reference value
is not matched until DTCNn equals DTRRn, and the prescaler indicates that DTCNn should be
incremented again. Thus, the reference register is matched after DTRRn+1 time intervals.
Table 22-4. DTERn Field Descriptions
Bits
Name
Description
7–2
—
Reserved, should be cleared.
1
REF
Output reference event. The counter value, DTCNn, equals the reference value, DTRRn.
Writing a one to REF clears the event condition. Writing a zero has no effect.
0
CAP
Capture event. The counter value has been latched into DTCRn. Writing a one to CAP
clears the event condition. Writing a zero has no effect.
REF
DTMRn[ORRI]
DTXMRn[DMAEN]
0
X
No event
1
0
No request asserted
1
0
1
No request asserted
1
0
Interrupt request asserted
1
DMA request asserted
CAP
DTMRn[CE]
DTXMRn
[DMAEN]
0
X
No event
1
00
0
Disable capture event output
1
00
1
Disable capture event output
1
01
0
Capture on rising edge & trigger interrupt
1
01
1
Capture on rising edge & trigger DMA
1
10
0
Capture on falling edge & trigger interrupt
1
10
1
Capture on falling edge & trigger DMA
1
11
0
Capture on any edge & trigger interrupt
1
11
1
Capture on any edge & trigger DMA
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