參數(shù)資料
型號： MCF5270AB100
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Integrated Microprocessor Hardware Specification
中文描述： 集成的微處理器，硬件規(guī)格
文件頁數(shù)： 31/40頁
文件大小： 863K
代理商： MCF5270AB100
Preliminary Electrical Characteristics
MCF5271 Integrated Microprocessor Hardware Specification, Rev. 2
Freescale Semiconductor
31
Figure 14. I
2
C Input/Output Timings
7.10
Fast Ethernet AC Timing Specifications
MII signals use TTL signal levels compatible with devices operating at either 5.0 V or 3.3 V.
7.10.1
MII Receive Signal Timing (ERXD[3:0], ERXDV, ERXER, and
ERXCLK)
The receiver functions correctly up to a ERXCLK maximum frequency of 25 MHz +1%. The processor
clock frequency must exceed twice the ERXCLK frequency.
Table 18
lists MII receive channel timings.
Figure 15
shows MII receive signal timings listed in
Table 18
.
Figure 15. MII Receive Signal Timing Diagram
Table 18. MII Receive Signal Timing
Num
Characteristic
Min
Max
Unit
M1
ERXD[3:0], ERXDV, ERXER to ERXCLK setup
5
—
ns
M2
ERXCLK to ERXD[3:0], ERXDV, ERXER hold
5
—
ns
M3
ERXCLK pulse width high
35%
65%
ERXCLK period
M4
ERXCLK pulse width low
35%
65%
ERXCLK period
I2
I6
I1
I4
I7
I8
I9
I5
I3
I2C_SCL
I2C_SDA
M1
M2
ERXCLK (input)
ERXD[3:0] (inputs)
ERXDV
ERXER
M3
M4
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PDF描述
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