參數(shù)資料
型號： MC908EY8VFAE
廠商： Freescale Semiconductor
文件頁數(shù)： 23/278頁
文件大?。?/td> 0K
描述： IC MCU 8K FLASH 8MHZ 32-LQFP
標(biāo)準(zhǔn)包裝： 250
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： LIN，SCI，SPI
外圍設(shè)備： POR，PWM
輸入/輸出數(shù)： 24
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 105°C
封裝/外殼： 32-LQFP
包裝： 托盤
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Port C
MC68HC908EY16 MC68HC908EY8 Data Sheet, Rev. 10
Freescale Semiconductor
119
12.4 Port C
Port C is an 5-bit general-purpose bidirectional I/O port that shares pin functions with the internal clock
generator (ICG) and serial peripheral interface (SPI) modules.
12.4.1 Port C Data Register
The port C data register contains a data latch for each of the five port C pins.
PTC[4:0] — Port C Data Bits
These read/write bits are software-programmable. Data direction of each port C pin is under the control
of the corresponding bit in data direction register C. Reset has no effect on port C data.
MCLK — T12 System Clock Bit
The system clock is driven out of PTC2 when enabled by MCLKEN bit in PTCDDR7.
12.4.2 Data Direction Register C
Data direction register C determines whether each port C pin is an input or an output. Writing a 1 to a
DDRC bit enables the output buffer for the corresponding port C pin; a 0 disables the output buffer.
MCLKEN — MCLK Enable Bit
This read/write bit enables MCLK to be an output signal on PTC2. If MCLK is enabled, PTC2 is under
the control of MCLKEN. Reset clears this bit.
1 = MCLK output enabled
0 = MCLK output disabled
Address:
$0002
Bit 7
654321
Bit 0
Read:
0
PTC4
PTC3
PTC2
PTC1
PTC0
Write:
Reset:
Unaffected by reset
Alternative Function:
OSC1
OSC2
MCLK
MOSI
MISO
= Unimplemented
Figure 12-7. Port C Data Register (PTC)
Address:
$0006
Bit 7
6
5
4321
Bit 0
Read:
MCLKEN
00
DDRC4
DDRC3
DDRC2
DDRC1
DDRC0
Write:
Reset:
000
00000
= Unimplemented
Figure 12-8. Data Direction Register C (DDRC)
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