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參數(shù)資料
| 型號(hào)： | MC68MH360CZQ25L |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 114/158頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU QUICC 25MHZ 357-PBGA |
| 標(biāo)準(zhǔn)包裝： | 44 |
| 系列： | M683xx |
| 處理器類型： | M683xx 32-位 |
| 速度： | 25MHz |
| 電壓： | 5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 357-BBGA |
| 供應(yīng)商設(shè)備封裝： | 357-PBGA（25x25） |
| 包裝： | 托盤 |
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Chapter 2. QMC Memory Organization
For the 860MH, RSTATE should be initialized to 0x3100_0000 before enabling the channel
—AT = 1. Note that for the 860MH, bit 4 should always be zero as only bits 5–7 map to
AT[1–3]. Table 2-15 describes the RSTATE elds for the 860MH with boldfaced
parameters to be initialized by the user.
Table 2-15. RSTATE Field Descriptions for 860MH (Transparent Mode)
Field
Name
Description
0–1
—
0
2—
1
3
MOT
Motorola/Intel bit
0 = The bus format is Intel format (little-endian).
1 = The system bus is considered to be organized in Motorola format (big-endian).
4—
0
5–7
AT[1–3]
Address type—This eld contains the address type for the transmitter DMA channel for data
buffers in external memory (transmit buffers). Address types are needed by the memory
controller to decode a correct memory cycle and activate the correct handshaking.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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