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參數(shù)資料
| 型號(hào)： | MC68HC05J1AVP |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP20 |
| 封裝： | PLASTIC, DIP-20 |
| 文件頁數(shù)： | 23/128頁 |
| 文件大?。?/td> | 1279K |
| 代理商： | MC68HC05J1AVP |
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MC68HCL05J1A
MC68HC05J1A — Rev. 3.0
Technical Data
MOTOROLA
MC68HCL05J1A
119
Table A-3. Low-Power Supply Current
Characteristic
Symbol
Min
Typ(1)
Max
Unit
Supply current (VDD = 4.5–5.5 Vdc, fop = 2.1 MHz)
Run(2)
Wait(3)
Stop(4)
25
°C
0
°C to 70°C (standard)
IDD
—
3.0
1.6
0.2
2.0
4.0
2.5
10
20
mA
A
Supply current (VDD = 2.5–3.6 Vdc, fop = 1.0 MHz)
Run(2)
Wait(3)
Stop(4)
25
°C
0
°C to 70°C (standard)
IDD
—
1.0
0.5
0.1
1.0
2.0
1.0
5.0
10.0
mA
A
Supply current (VDD = 2.5–3.6 Vdc, fop = 500 kHz)
Run(2)
Wait(3)
Stop(4)
25
°C
0
°C to 70°C (standard)
IDD
—
0.5
250
0.1
1.0
500
5.0
10.0
mA
A
Supply current (VDD = 1.8–2.4 Vdc, fop = 500 kHz)
Run(2)
Wait(3)
Stop(4)
25
°C
0
°C to 70°C (standard)
IDD
—
300
150
0.1
1.0
700
400
2
5
A
1. Typical values reflect average measurements at midpoint of voltage range at 25
°C.
2. Run (operating) IDD measured using external square wave clock source with all inputs 0.2 V from rail. No dc loads. Less
than 50 pF on all outputs. CL = 20 pF on OSC2.
3. WAIT IDD measured using external square wave clock source with all inputs 0.2 V from rail. No dc loads. Less than
50 pF on all outputs. CL = 20 pF on OSC2. All ports configured as inputs. VIL =0.2 V, VIH =VDD –0.2 V. OSC2
capacitance linearly affects WAIT IDD.
4. Stop IDD measured with OSC1 = VDD. All ports configured as inputs. VIL = 0.2 V, VIH =VDD –0.2 V.
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PDF描述 |
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