參數(shù)資料
型號(hào)： MC56F8322VFAER2
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 125/136頁(yè)
文件大?。?/td> 0K
描述： IC HYBRID CTRLR 16BIT 48-LQFP
標(biāo)準(zhǔn)包裝： 2,000
系列： 56F8xxx
核心處理器： 56800E
芯體尺寸： 16-位
速度： 60MHz
連通性： CAN，SCI，SPI
外圍設(shè)備： POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 21
程序存儲(chǔ)器容量： 40KB（20K x 16）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 6K x 16
電壓 - 電源 (Vcc/Vdd)： 2.25 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 105°C
封裝/外殼： 48-LQFP
包裝： 帶卷 (TR)
配用： MC56F8323EVME-ND - BOARD EVALUATION MC56F8323
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Register Descriptions
56F8322 Technical Data, Rev. 16
Freescale Semiconductor
89
Preliminary
6.5.8.4
GPIOB1 (B1)—Bit 5
This bit selects the alternate function for GPIOB1.
0 = MISO0 (default)
1 = RXD1
6.5.8.5
GPIOB0 (B0)—Bit 4
This bit selects the alternate function for GPIOB0.
0 = SS0 (default)
1 = TXD1
6.5.8.6
GPIOA5 (A5)—Bit 3
This bit selects the alternate function for GPIOA5.
0 = PWMA5
1 = SCLK1
6.5.8.7
GPIOA4 (A4)—Bit 2
This bit selects the alternate function for GPIOA4.
0 = PWMA4
1 = MOS1
6.5.8.8
GPIOA3 (A3)—Bit 1
This bit selects the alternate function for GPIOA3.
0 = PWMA3
1 = MISO1
6.5.8.9
GPIOA2 (A2)—Bit 0
This bit selects the alternate function for GPIOA2.
0 = PWMA2
1 = SS1
6.5.9
Peripheral Clock Enable Register (SIM_PCE)
The Peripheral Clock Enable register is used to enable or disable clocks to the peripherals as a power
savings feature. The clocks can be individually controlled for each peripheral on the chip.
Figure 6-12 Peripheral Clock Enable Register (SIM_PCE)
Base + $C
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
1
ADCA
CAN
1
DEC0
1
TMRC
1
TMRA
SCI 1
SCI 0
SPI1
SPI0
1
PWMA
Write
RESET
1
11
1
111
1
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PDF描述
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MC56F8323EVME 功能描述:開(kāi)發(fā)板和工具包 - 其他處理器 MC56F8323 EVAL BRD RoHS:否 制造商:Freescale Semiconductor 產(chǎn)品:Development Systems 工具用于評(píng)估:P3041 核心:e500mc 接口類(lèi)型:I2C, SPI, USB 工作電源電壓:
MC56F8323EVME 制造商:Freescale Semiconductor 功能描述:Evaluation Kit for MC56F832x and MC56F81
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