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參數(shù)資料
型號(hào)： MB95F204KP-G-SH-SNE2
廠商： Fujitsu Semiconductor America Inc
文件頁數(shù)： 39/72頁
文件大?。?/td> 0K
描述： IC MCU 16KB FLASH F2MC8FX 24SDIP
特色產(chǎn)品： Low Pin Count MCUs
標(biāo)準(zhǔn)包裝： 1
系列： F²MC MB95200H
核心處理器： F²MC-8FX
芯體尺寸： 8-位
速度： 16MHz
連通性： LIN，LPC，SIO，UART/USART
外圍設(shè)備： LVD，POR，PWM，WDT
輸入/輸出數(shù)： 17
程序存儲(chǔ)器容量： 16KB（16K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 496 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x8/10b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 24-SDIP（0.300"，7.62mm）
包裝： 管件
產(chǎn)品目錄頁面： 722 (CN2011-ZH PDF)
其它名稱： 865-1058
MB95200H/210H Series
44
DS07-12623-3E
(6) LIN-UART Timing (Available in MB95F204H/F203H/F202H/F204K/F203K/F202K only)
Sampling is executed at the rising edge of the sampling clock*1, and serial clock delay is disabled*2.
(ESCR register : SCES bit = 0, ECCR register : SCDE bit = 0)
(VCC = 5.0 V
±10%, AVSS = VSS = 0.0 V, TA = -40°C to +85°C)
*1: There is a function used to choose whether the sampling of reception data is performed at a rising edge or a
falling edge of the serial clock.
*2: The serial clock delay function is a function used to delay the output signal of the serial clock for half the clock.
*3: See “(2) Source Clock/Machine Clock” for tMCLK.
Parameter
Symbol Pin name
Condition
Value
Unit
Min
Max
Serial clock cycle time
tSCYC
SCK
Internal clock
operation output pin:
CL = 80 pF
+1 TTL
5 tMCLK*3
—ns
SCK
↓→ SOT delay time
tSLOVI
SCK, SOT
-95
+95
ns
Valid SIN
→ SCK ↑
tIVSHI
SCK, SIN
tMCLK*3
+190
—
ns
SCK
↑→ valid SIN hold time
tSHIXI
SCK, SIN
0
—
ns
Serial clock “L” pulse width
tSLSH
SCK
External clock
operation output pin:
CL = 80 pF
+1 TTL
3 tMCLK*3
tR
—ns
Serial clock “H” pulse width
tSHSL
SCK
tMCLK*3
+95
—
ns
SCK
↓→ SOT delay time
tSLOVE
SCK, SOT
—
2 tMCLK*3
+95
ns
Valid SIN
→ SCK ↑
tIVSHE
SCK, SIN
190
—
ns
SCK
↑→ valid SIN hold time
tSHIXE
SCK, SIN
tMCLK*3
+95
—
ns
SCK fall time
tF
SCK
—
10
ns
SCK rise time
tR
SCK
—
10
ns
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PDF描述
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參數(shù)描述
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MB95F214KPF-ES-SNE2 制造商:FUJITSU 功能描述:
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