參數(shù)資料
型號(hào)： MA330011
廠商： Microchip Technology
文件頁數(shù)： 44/199頁
文件大小： 0K
描述： MODULE DSPIC33 100P TO 100QFP
標(biāo)準(zhǔn)包裝： 1
附件類型： 插拔式模塊（PIM）- dsPIC33FJ256GP710
適用于相關(guān)產(chǎn)品： Explorer 16（DM240001 或 DM240002）
產(chǎn)品目錄頁面： 658 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： DSPIC33FJ64GP710T-I/PT-ND - IC DSPIC MCU/DSP 64K 100TQFP
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dsPIC33F
DS70165E-page 136
Preliminary
2007 Microchip Technology Inc.
FIGURE 7-1:
TOP LEVEL SYSTEM ARCHITECTURE USING A DEDICATED TRANSACTION BUS
7.1
DMAC Registers
Each DMAC Channel x (x = 0, 1, 2, 3, 4, 5, 6 or 7)
contains the following registers:
A 16-bit DMA Channel Control register
(DMAxCON)
A 16-bit DMA Channel IRQ Select register
(DMAxREQ)
A 16-bit DMA RAM Primary Start Address register
(DMAxSTA)
A 16-bit DMA RAM Secondary Start Address
register (DMAxSTB)
A 16-bit DMA Peripheral Address register
(DMAxPAD)
A 10-bit DMA Transfer Count register (DMAx-
CNT)
An additional pair of status registers, DMACS0 and
DMACS1, are common to all DMAC channels.
DMACS0 contains the DMA RAM and SFR write colli-
sion flags, XWCOLx and PWCOLx, respectively.
DMACS1 indicates DMA channel and Ping-Pong
mode status.
The
DMAxCON,
DMAxREQ,
DMAxPAD
and
DMAxCNT are all conventional read/write registers.
Reads of DMAxSTA or DMAxSTB will read the con-
tents of the DMA RAM Address register. Writes to
DMAxSTA or DMAxSTB write to the registers. This
allows the user to determine the DMA buffer pointer
value (address) at any time.
The interrupt flags (DMAxIF) are located in an IFSx
register in the interrupt controller. The corresponding
interrupt enable control bits (DMAxIE) are located in
an IECx register in the interrupt controller, and the cor-
responding interrupt priority control bits (DMAxIP) are
located in an IPCx register in the interrupt controller.
7.2
DMAC Operating Modes
Each DMA channel has its own status and control reg-
ister (DMAxCON) that is used to configure the channel
to support the following operating modes:
Word or byte size data transfers
Peripheral to DMA RAM or DMA RAM to
peripheral transfers
Post-increment or static DMA RAM address
One-shot or continuous block transfers
Auto-switch between two start addresses after
each transfer complete (Ping-Pong mode)
Force a single DMA transfer (Manual mode)
Each DMA channel can be independently configured
to:
Select from one of 20 DMA request sources
Manually enable or disable the DMA channel
Interrupt the CPU when the transfer is half or fully
complete
DMA channel interrupts are routed to the interrupt con-
troller module and enabled through associated enable
flags.
The channel DMA RAM and peripheral write collision
Faults are combined into a single DMAC error trap
(Level 10) and are not maskable. Each channel has
DMA RAM write collision (XWCOLx) and peripheral
CPU
SRAM
DMA RAM
CPU Peripheral DS Bus
Peripheral 3
DMA
Peripheral
Non-DMA
SRAM X-Bus
PORT 2
PORT 1
Peripheral 1
DMA
Ready
Peripheral 2
DMA
Ready
DMA DS Bus
CPU
DMA
CPU
DMA
CPU
DMA
Peripheral Indirect Address
Note: CPU and DMA address buses are not shown for clarity.
DMA
Cont
ro
l
DMA Controller
DMA
Channels
相關(guān)PDF資料
PDF描述
MA320001 MODULE PLUG-IN PIC32 100QFP
RBM08DRMT-S288 CONN EDGECARD 16POS .156 EXTEND
GSM12DTKN-S288 CONN EDGECARD 24POS .156 EXTEND
AC002021 CABLE MPLAB PM3 ICSP
GSM12DTKH-S288 CONN EDGECARD 24POS .156 EXTEND
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MA330011 制造商:Microchip Technology Inc 功能描述:dsPIC33 GP 100P to 100P TQFP Plug-In Mod
MA330012 功能描述:子卡和OEM板 dsPIC33F GP 100P to 84P Plug In Module RoHS:否 制造商:BeagleBoard by CircuitCo 產(chǎn)品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit
MA330013 功能描述:子卡和OEM板 dsPIC33F Plug In Module RoHS:否 制造商:BeagleBoard by CircuitCo 產(chǎn)品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit
MA330014 功能描述:子卡和OEM板 dsPIC33 MC RoHS:否 制造商:BeagleBoard by CircuitCo 產(chǎn)品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit
MA330015 功能描述:子卡和OEM板 dsPIC33 GP RoHS:否 制造商:BeagleBoard by CircuitCo 產(chǎn)品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit
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