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參數(shù)資料
| 型號： | ISPLSI1016EA-200LT44 |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | In-System Programmable High Density PLD |
| 中文描述： | EE PLD, 6 ns, PQFP44 |
| 封裝： | TQFP-44 |
| 文件頁數(shù)： | 9/13頁 |
| 文件大?。?/td> | 162K |
| 代理商： | ISPLSI1016EA-200LT44 |
9
Specifications
ispLSI 1016EA
ispLSI 1016EA Timing Model
GLB Reg
Delay
I/O Pin
(Output)
ORP
Delay
0491/1016EA
Feedback
#46
Reg 4 PT Bypass
#34
20 PT
XOR Delays
Control
PTs
#43 - 45
Input
RST
DiClock
I/O Pin
(Input)
Y0
Y1
D
Q
GRP4
#30
GLB Reg Bypass
#38
ORP Bypass
#48
D
Q
RST
RE
OE
CK
I/O Reg Bypass
#22
I/O Cell
ORP
GLB
GRP
I/O Cell
#23 - 27
#33 Comb 4 PT Bypass
#35 - 37
#55 - 58
#54
#53
#47
Reset
Ded. In
GOE 0
#28
#59
#59
#39 - 42
#51, 52
#49, 50
GRP Loading
Delay
#29, 31 - 32
Derivations of
t
su,
t
h and
t
co from the Product Term Clock
1
=
=
=
=
(0.3 + 1.5 + 1.9) + (0.2) - (0.3 + 1.5 + 1.2)
0.9
t
su
Logic + Reg su - Clock (min)
(
t
iobp +
t
grp4 +
t
20ptxor) + (
t
gsu) - (
t
iobp +
t
grp4 +
t
ptck(min))
(#22 + #30 + #36) + (#39) - (#22 + #30 + #45)
1.6
7.2
1.1
1.4
7.2
=
=
=
=
t
h
Clock (max) + Reg h - Logic
(
t
iobp +
t
grp4 +
t
ptck(max)) + (
t
gh) - (
t
iobp +
t
grp4 +
t
(#22 + #30 + #45) + (#40) - (#22 + #30 + #36)
(0.3 + 1.5 + 2.5) + (1.0) - (0.3 + 1.5 + 1.9)
=
=
=
=
t
co
Clock (max) + Reg co + Output
(
t
iobp +
t
grp4 +
t
ptck(max)) + (
t
gco) + (
t
orp +
t
ob)
(#22 + #30 + #45) + (#41) + (#47 + #49)
(0.3 + 1.5 + 2.5) + (1.4) + (0.8 + 0.9)
Table 2-0042a/1016EA
v.2.6
Derivations of
t
su,
t
h and
t
co from the Clock GLB
1
=
=
=
=
t
su
Logic + Reg (setup) - Clock (min)
(
t
iobp +
t
grp4 +
t
20ptxor) + (
t
gsu) - (
t
gy0(min) +
t
gco +
t
gcp(min))
(#22 + #30 + #36) + (#39) - (#54 + #41 + #56)
(0.3 + 1.5 + 1.9) + (0.2) - (0.9 + 1.4 + 0.8)
=
=
=
=
t
h
Clock (max) + Reg (hold) - Logic
(
t
gy0(max) +
t
gco +
t
gcp(max)) + (
t
gh) - (
t
iobp +
t
grp4 +
t
20ptxor)
(#54 + #41 + #56) + (#40) - (#22 + #30 + #36)
(0.9 + 1.4 + 1.8) + (1.0) - (0.3 + 1.5 + 1.9)
=
=
=
=
t
co
Clock (max) + Reg (clock-to-out) + Output
(
t
gy0(max) +
t
gco +
t
gcp(max)) + (
t
gco) + (
t
orp +
t
ob)
(#54 + #41 + #56) + (#41) + (#47 + #49)
(0.9 + 1.4 + 1.8) + (1.4) + (0.8 + 0.9)
1. Calculations are based upon timing specifications for the ispLSI 1016EA-200.
相關PDF資料 |
PDF描述 |
|---|---|
| ispLSI1016 | In-System Programmable High Density PLD |
| ISPLSI1016E | In-System Programmable High Density PLD |
| ISPLSI1016E-125LJ | In-System Programmable High Density PLD |
| ISPLSI1016E-125LT44 | In-System Programmable High Density PLD |
| ISPLSI1016E-80LJ | In-System Programmable High Density PLD |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ISPLSI1024-50LJ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Electrically-Erasable Complex PLD |
| ISPLSI1024-60LH/883 | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable High Density PLD |
| ispLSI1024-60LJ | 功能描述:CPLD - 復雜可編程邏輯器件 USE ispMACH 4000V RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ispLSI1024-60LJI | 功能描述:CPLD - 復雜可編程邏輯器件 USE ispMACH 4000V RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ISPLSI1024-60LT | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Electrically-Erasable Complex PLD |
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