參數(shù)資料
型號: ISPGDX160VA-7B208
廠商: LATTICE SEMICONDUCTOR CORP
元件分類: PLD
英文描述: In-System Programmable 3.3V Generic Digital CrosspointTM
中文描述: EE PLD, 7 ns, PBGA208
封裝: FBGA-208
文件頁數(shù): 21/37頁
文件大?。?/td> 464K
代理商: ISPGDX160VA-7B208
21
Specifications
ispGDX160V/VA
Switching Waveforms
Clock Width
CLK
(I/O INPUT)
t
wl
t
wh
COMBINATORIAL
I/O OUTPUT
VALID INPUT
DATA (I/O INPUT)
t
pd
t
sel
VALID INPUT
MUXSEL (I/O INPUT)
Combinatorial Output
COMBINATORIAL
I/O OUTPUT
OE (I/O INPUT)
t
en
t
dis
I/O Output Enable/Disable
Registered Output
Reset
REGISTERED
I/O OUTPUT
t
rst
RESET
t
rw
I/O Pin
RESET
TOE
Y0,1,2,3
Y0,1,2,3, Enable
tgclk #61
tgclkeng #62
tgclkenio #63
MUX0
MUX1
tgrp #33
MUX Expander Input
GRP
A
B
C
D
OE
tgoe #58
tmuxexp #35
tmuxselexp #39
tiobp #48
CLK
CLKEN
MUX Expander Output
tioob #49
tmuxd #34
tmuxs #36
tmuxio #37
tmuxg #38
tmuxcg #50
tmuxcio #51
tiod #52, #53
tgr #65
0902/gdx160v/va
tio #32
tfdbk #47
tioclk #60
tioclkeg #64
tiolat #40
tiosu #41
tioh #42
tioco #43
tior #44
tcesu #45
tceh #46
tob #54
tobs #55
toeen #56
toedis #57
ttoe #59
CLK
CLKEN
D
Q
DATA
(I/O INPUT)
REGISTERED
I/O OUTPUT
CLK
CLKEN
VALID INPUT
t
t
h
t
gco
t
suce
t
ceh
t
co
1/
f
max
(external fdbk)
su
ispGDXV Timing Model
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