參數(shù)資料
型號(hào): ISP1161A1BM
廠商: NXP SEMICONDUCTORS
元件分類: 總線控制器
英文描述: Universal Serial Bus single-chip host and device controller
中文描述: UNIVERSAL SERIAL BUS CONTROLLER, PQFP64
封裝: 7 X 7 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-414-1, LQFP-64
文件頁(yè)數(shù): 62/127頁(yè)
文件大小: 2762K
代理商: ISP1161A1BM
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Philips Semiconductors
ISP1161
Full-speed USB single-chip host and device controller
Product data
Rev. 01 — 3 July 2001
62 of 130
9397 750 08313
Philips Electronics N.V. 2001. All rights reserved.
Code (Hex): 05 —
read
Code (Hex): 85 —
write
13.2 HC frame counter registers
13.2.1
HcFmInterval Register
The HcFmInterval register contains a 14-bit value which indicates the bit time interval
in a frame (that is, between two consecutive SOFs), and a 15-bit value indicating the
full-speed maximum packet size that the HC may transmit or receive without causing
a scheduling overrun. The HCD may carry out minor adjustments on the
FrameInterval by writing a new value over the present one at each SOF. This provides
the programmability necessary for the HC to synchronize with an external clocking
resource and to adjust any unknown local clock offset.
5
FNO
0 —
ignore
1 —
disable interrupt generation due to frame Number Overflow
0 —
ignore
1 —
disable interrupt generation due to Unrecoverable Error
0 —
ignore
1 —
disable interrupt generation due to Resume Detect
0 —
ignore
1 —
disable interrupt generation due to Start of frame
reserved
0 —
ignore
1 —
disable interrupt generation due to Scheduling Overrun
4
UE
3
RD
2
SF
1
0
-
SO
Table 27: HcInterruptDisable Register: bit description
…continued
Bit
Symbol
Description
Table 28: HcFmInterval Register: bit allocation
Bit
31
Symbol
FIT
Reset
0
Access
R/W
Bit
23
Symbol
Reset
0
Access
Bit
15
Symbol
reserved
Reset
0
Access
Bit
7
Symbol
Reset
1
Access
30
29
28
27
26
25
24
FSMPS[14:8]
0
R/W
19
FSMPS[7:0]
0
0
0
0
0
0
22
21
20
18
17
16
0
0
0
0
0
0
0
R/W
14
13
12
11
10
9
8
FI[13:8]
0
1
0
1
1
1
0
R/W
R/W
6
5
4
3
2
1
0
FI[7:0]
1
0
1
1
1
1
1
R/W
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PDF描述
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