參數(shù)資料
型號： ISL6130
廠商： Intersil Corporation
英文描述： Power Sequencing Controllers
中文描述： 電源順序控制器
文件頁數(shù)： 8/21頁
文件大?。?/td> 488K
代理商： ISL6130
8
FN9005.8
February 5, 2007
Figure 2 illustrates the turn-on and Figure 3 illustrates the
nominal turnoff timing diagram of the
ISL6123
and
ISL6124
product.
The
ISL6125
is similar to the ISL6124 except that instead of
charge pumped GATE outputs, there are sequenced open
drain outputs that can be pulled up to a maximum of V
DD
.
Note the delay and flexible sequencing possibilities. Multiple
series, parallel or adjustable capacitors can be used to easily
fine tune timing between that offered by standard value
capacitors.
l
TABLE 1.
NOMINAL DELAY TO SEQUENCING THRESHOLD
DLY PIN CAPACITANCE
TIME(s)
Open
0.00006
100pF
0.00013
1000pF
0.0013
0.01
μ
F
0.013
0.1
μ
F
0.13
1
μ
F
1.3
10
μ
F
13
NOTE: Nom. T
DEL_SEQ
= Cap (
μ
F) * 1.3M
Ω
.
FIGURE 2. ISL6123, ISL6124 TURN-ON AND GLITCH RESPONSE TIMING DIAGRAM
UVLO_B
UVLO_C
UVLO_D
ENABLE (ISL6123)
RESET#
DLYON_A
DLYON_B
DLYON_C
DLYON_D
GATE_A
GATE_B
GATE_C
GATE_D
UVLO_A
V
EN
DLY_Vth
DLY_Vth
DLY_Vth
DLY_Vth
V
QPUMP
V
QPUMP
V
QPUMP
ENABLE# (ISL6124)
V
UVLOVth
V
UVLOVth
V
UVLOVth
V
UVLOVth
T
RSTdel
T
UVLOdel
V
QPUMP
-1V
V
QPUMP
<TFIL
ISL6123, ISL6124, ISL6125, ISL6126, ISL6127, ISL6128, ISL6130
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PDF描述
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參數(shù)描述
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