參數(shù)資料
型號： ICS932S890CKLF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 8/21頁
文件大?。?/td> 0K
描述： IC CLK CHIP EXPRESS 72MLF
標(biāo)準(zhǔn)包裝： 168
類型： 時鐘/頻率合成器
PLL： 是
主要目的： AMD CPU
輸入： 晶體
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:27
差分 - 輸入:輸出： 無/是
頻率 - 最大： 212.24MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 72-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 72-VFQFPN（10x10）
包裝： 托盤
932S890C
RD890 SYSTEM CLOCK FOR AMD-BASED SERVERS
IDT
RD890 SYSTEM CLOCK FOR AMD-BASED SERVERS
16
932S890C
REV D 052011
SMBUS Table: SR C Frequency Control Register
Byte
15
Name
Control Function
Type
0
1
Default
Bit 7
N Div2
N Divider Prog bit 2
R W
X
Bit 6
N Div1
N Divider Prog bit 1
R W
X
Bit 5
M Div5
R W
X
Bit 4
M Div4
R W
X
Bit 3
M Div3
R W
X
Bit 2
M Div2
R W
X
Bit 1
M Div1
R W
X
Bit 0
M Div0
R W
X
SMBUS Table: SR C Frequency Control Register
Byte
16
Name
Control Function
Type
0
1
Default
Bit 7
N Div10
R W
X
Bit 6
N Div9
RW
X
Bit 5
N Div8
RW
X
Bit 4
N Div7
RW
X
Bit 3
N Div6
RW
X
Bit 2
N Div5
RW
X
Bit 1
N Div4
RW
X
Bit 0
N Div3
RW
X
SMBUS Table: SR C Spread Spectrum Control Register
Byte
17
Name
Control Function
Type
0
1
Default
Bit 7
SSP7
R W
X
Bit 6
SSP6
R W
X
Bit 5
SSP5
R W
X
Bit 4
SSP4
R W
X
Bit 3
SSP3
R W
X
Bit 2
SSP2
R W
X
Bit 1
SSP1
R W
X
Bit 0
SSP0
R W
X
SMBUS Table: SR C Spread Spectrum Control Register
Byte
18
Name
Control Function
Type
0
1
Default
Bit 7
SSP15
R W
X
Bit 6
SSP14
R W
X
Bit 5
SSP13
R W
X
Bit 4
SSP12
R W
X
Bit 3
SSP11
R W
X
Bit 2
SSP10
R W
X
Bit 1
SSP9
R W
X
Bit 0
SSP8
R W
X
SMBus Table: SRC N Divider Control Register
Byte
19
Name
Control Function
Type
0
1
Default
Bit 7
SRC N Div0
LSB N Divider Programming
R W
X
Bit 6
0
Bit 5
0
Bit 4
0
Bit 3
0
Bit 2
0
Bit 1
0
Bit 0
0
Reserved
M Divider Programming
bit (5:0)
N Divider Programming
Byte16 bit(7:0) and Byte15
bit(7:6)
Reserved
N Divider LSB (bit 0) for SRC M/N programming.
The decimal representation of M and N Divider in Byte
15 and 16 configure the SRC VCO frequency. See
M/N Caculation Tables for VCO frequency formulas.
The decimal representation of M and N Divider in Byte
15 and 16 configure the SRC VCO frequency. See
M/N Caculation Tables for VCO frequency formulas.
Spread Spectrum
Programming bit(15:8)
Spread Spectrum
Programming bit(7:0)
These bits set the SRC spread pecentages.Please
contact IDT for the appropriate values.
These bits set the SRC spread pecentages.Please
contact IDT for the appropriate values.
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PDF描述
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